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MT88V32APR1

更新时间： 2024-02-15 16:25:05
品牌 Logo 应用领域
美高森美 - MICROSEMI PC
页数 文件大小 规格书
19页 314K
描述
8-CHANNEL, CROSS POINT SWITCH, PQCC44, LEAD FREE, PLASTIC, MS-018AC, LCC-44

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MT88V32APR1 技术参数

是否Rohs认证： 符合生命周期：Obsolete
包装说明：QCCJ,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.76
其他特性：VIDEO APPLICATION; 8 X 4 ARRAY模拟集成电路 - 其他类型：CROSS POINT SWITCH
JESD-30 代码：S-PQCC-J44JESD-609代码：e3
长度：16.585 mm湿度敏感等级：3
负电源电压最大值（Vsup）：-8.5 V负电源电压最小值（Vsup）：
标称负供电电压 (Vsup)：-7 V信道数量：8
功能数量：1端子数量：44
标称断态隔离度：62 dB通态电阻匹配规范：6 Ω
最大通态电阻 (Ron)：65 Ω最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：4.57 mm
最大供电电压 (Vsup)：13.2 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：MATTE TIN端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：16.585 mm
Base Number Matches：1

MT88V32APR1 数据手册

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MT88V32  
8 x 4 High Performance Video Switch  
Array  
Data Sheet  
March 2006  
Features  
•
32 bidirectional CMOS "T" switches in an 8×4  
Ordering Information  
non-blocking array  
MT88V32AP  
44 Pin PLCC  
44 Pin PLCC  
44 Pin PLCC*  
Tubes  
Tape & Reel  
Tubes  
Tape & Reel  
MT88V32APR  
MT88V32AP1  
MT88V32APR1  
•
•
•
•
Break-before-make switching configuration  
Fast setup & hold times for switch programming  
3 dB bandwidth of 200 MHz  
44 Pin PLCC*  
*Pb Free Matte Tin  
-40°C to +85°C  
Low feedthrough and crosstalk, better than -  
80 dB at 5 MHz  
Description  
•
•
•
Very low differential gain and phase errors  
12Vpp bipolar signal capability  
The MT88V32 is a digitally programmable (TTL levels)  
8×4 crosspoint switch that is designed to control wide-  
band analog (video) signal.  
On-state resistance 75 Ω (max) for VDD=+5V,  
VEE=-7V  
Each of the 32 nodes of the switching matrix has a T-  
switch, see Fig.1. This grounds the nodes of all open  
connections, which greatly reduces feedthrough noise.  
In order to reduce crosstalk, individual analog signal  
lines are isolated by interleaving them with ground  
lines.  
•
•
Switch control through 2-stage latches  
Orthogonal Xi and Yi pin connections for  
optimized PCB layout  
•
Latch readback capability for monitoring  
The two stage programmable latch system allows the  
state of all switching nodes to be updated  
simultaneously. The next state of the switch is written  
into the first stage of the latches through individual  
write cycles. These changes will not affect the current  
state of the switch. The STROBE2 control input is used  
to load the state of all first stage latches to the second  
stage latches, which updates the complete matrix.  
Applications  
•
•
•
•
High-end video routing and switching  
Medical instrumentation  
Automatic test equipment (ATE)  
Multi-media communication  
Y0-Y7  
VDD VEE VSS  
X0  
X1  
GND  
MR  
8x4  
"T" Switch Array  
X2  
X3  
Xi  
Yi  
2nd Stage Latches  
1st Stage Latches  
Address Decode  
STROBE2  
STROBE1  
R/W  
DATA  
CS  
I/O  
Control  
Logic  
GND  
T-Switch Configuration  
AY0-AY2  
AX0-AX1  
Figure 1 - Functional Block Diagram  
1
Zarlink Semiconductor Inc.  
Zarlink, ZL and the Zarlink Semiconductor logo are trademarks of Zarlink Semiconductor Inc.  
Copyright 1993-2006, Zarlink Semiconductor Inc. All Rights Reserved.  
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