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MC10E1652FN

更新时间： 2024-01-31 07:34:54
品牌 Logo 应用领域
安森美 - ONSEMI 锁存器比较器
页数 文件大小 规格书
10页 139K
描述
5V, −5V ECL Dual ECL Output Comparator with Latch

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MC10E1652FN 技术参数

是否无铅： 含铅生命周期：Obsolete
零件包装代码：QLCC包装说明：PLASTIC, LCC-20
针数：20Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：6.79
系列：10EJESD-30 代码：S-PQCC-J20
JESD-609代码：e0长度：8.965 mm
逻辑集成电路类型：MAGNITUDE COMPARATOR湿度敏感等级：1
位数：1功能数量：2
端子数量：20最高工作温度：85 °C
最低工作温度：输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装形状：SQUARE封装形式：CHIP CARRIER
峰值回流温度（摄氏度）：240传播延迟（tpd）：1.075 ns
认证状态：Not Qualified座面最大高度：4.57 mm
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：ECL温度等级：OTHER
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：8.965 mm
Base Number Matches：1

MC10E1652FN 数据手册

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MC10E1652  
5V, −5V ECL Dual ECL Output  
Comparator with Latch  
The MC10E1652 is fabricated using ON Semiconductor’s advanced  
MOSAIC IIIt process and is output compatible with 10H logic  
devices. In addition, the device is available in both a 16-pin DIP and a  
20-pin surface mount package. However, the MC10E1652 provides  
user programmable hysteresis.  
http://onsemi.com  
MARKING  
DIAGRAMS  
The latch enable (LEN and LEN ) input pins operate from standard  
a
b
ECL 10H logic levels. When the latch enable is at a logic high level,  
the MC10E1652 acts as a comparator; hence, Q will be at a logic high  
level if V1 > V2 (V1 is more positive than V2). Q is the complement  
of Q. When the latch enable input goes to a low logic level, the outputs  
are latched in their present state, providing the latch enable setup and  
hold time constraints are met. The level of input hysteresis is  
controlled by applying a bias voltage to the HYS pin.  
16  
MC10E1652L  
AWLYYWW  
1
CDIP−16  
L SUFFIX  
CASE 620A  
Features  
• Typical 3.0 dB Bandwidth > 1.0 GHz  
• Typical V to Q Propagation Delay of 775 ps  
• Typical Output Rise/Fall of 350 ps  
• Common Mode Range −2.0 V to +3.0 V  
• Individual Latch Enables  
1 20  
MC10E  
1652FNG  
AWLYYWW  
20  
1
• Differential Outputs  
PLCC−20  
FN SUFFIX  
CASE 775  
• Operating Mode: V = 5.0 V, V = −5.2 V, GND = 0 V  
CC  
EE  
• Programmable Input Hysteresis  
A
= Assembly Location  
= Wafer Lot  
= Year  
= Work Week  
= Pb−Free Package  
• No Internal Input Pulldown Resistors  
WL  
YY  
WW  
G
• ESD Protection: Human Body Model; > 2 kV,  
Machine Model; > 100 V  
• Meets or Exceeds JEDEC Spec EIA/JESD78 IC Latchup Test  
• Moisture Sensitivity Level 1  
For Additional Information, see Application Note AND8003/D  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 7 of this data sheet.  
• Flammability Rating: UL 94 V−O @ 0.125 in,  
Oxygen Index: 28 to 34  
• Transistor Count = 85 devices  
• Pb−Free Packages are Available*  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
November, 2006 − Rev. 9  
MC10E1652/D  
1234567...10

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