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MAX7320AEE-T PDF预览

MAX7320AEE-T

更新时间： 2024-01-28 17:28:43
品牌 Logo 应用领域
美信 - MAXIM 信息通信管理光电二极管外围集成电路
页数 文件大小 规格书
14页 271K
描述
Parallel I/O Port, 8-Bit, 8 I/O, BICMOS, PDSO16, 0.150 INCH, 0.635 MM PITCH, LEAD FREE, MO137AB, QSOP-16

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MAX7320AEE-T 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SSOP, SSOP16,.25针数：16
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.36
JESD-30 代码：R-PDSO-G16JESD-609代码：e0
长度：4.89 mm位数：8
I/O 线路数量：8端口数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装等效代码：SSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED电源：1.8/5 V
认证状态：Not Qualified座面最大高度：1.73 mm
子类别：Parallel IO Port最大供电电压：5.5 V
最小供电电压：1.71 V标称供电电压：3.3 V
表面贴装：YES技术：BICMOS
温度等级：AUTOMOTIVE端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：3.9 mmuPs/uCs/外围集成电路类型：PARALLEL IO PORT, GENERAL PURPOSE
Base Number Matches：1

MAX7320AEE-T 数据手册

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I2C Port Expander with Eight Push-Pull Outputs  
Typical Operating Characteristics  
(T = +2ꢀ°C, unless otherwise noted.)  
A
STANDBY CURRENT vs. TEMPERATURE  
SUPPLY CURRENT vs. TEMPERATURE  
60  
50  
40  
30  
20  
10  
0
2.0  
1.8  
1.6  
1.4  
1.2  
1.0  
0.8  
0.6  
0.4  
0.2  
0
f
= 0kHz  
f
= 400kHz  
SCL  
SCL  
V+ = +5.0V  
V+ = +5.0V  
V+ = +3.3V  
V+ = +3.3V  
V+ = +2.5V  
V+ = +2.5V  
V+ = +1.71V  
V+ = +1.71V  
-40 -25 -10  
5
20 35 50 65 80 95 110 125  
-40 -25 -10  
5
20 35 50 65 80 95 110 125  
TEMPERATURE (°C)  
TEMPERATURE (°C)  
OUTPUT VOLTAGE HIGH  
vs. TEMPERATURE  
OUTPUT VOLTAGE LOW  
vs. TEMPERATURE  
6
5
4
3
2
1
0
0.50  
0.45  
0.40  
0.35  
0.30  
0.25  
0.20  
0.15  
0.10  
0.05  
0
V+ = +5.0V  
= 5mA  
I
SOURCE  
V+ = +3.3V  
= 3mA  
I
V+ = +5.0V  
= 5mA  
SINK  
V+ = +3.3V  
= 3mA  
V+ = +2.5V  
= 2mA  
I
I
SINK  
SOURCE  
I
SINK  
V+ = +2.5V  
= 2mA  
V+ = +1.71V  
= 1mA  
V+ = +1.71V  
= 1mA  
I
SOURCE  
I
I
SINK  
SOURCE  
-40 -25 -10  
5
20 35 50 65 80 95 110 125  
-40 -25 -10  
5
20 35 50 65 80 95 110 125  
TEMPERATURE (°C)  
TEMPERATURE (°C)  
Pin Description  
PIN  
NAME  
FUNCTION  
QSOP  
1, 3  
2
TQFN  
1ꢀ, 1  
16  
Address Inputs. Select device slave address with AD0 and AD2. Connect AD0 and AD2  
to either GND, V+, SCL, or SDA to give four logic co5binations (see Table 3).  
AD0, AD2  
RST  
O0–O7  
GND  
N.C.  
SCL  
SDA  
V+  
Reset Input, Active Low. Drive RST low to clear the 2-wire interface.  
Output Ports. O0 to O7 are push-pull outputs.  
Ground  
4–7, 9–12 2–ꢀ, 7–10  
8
6
13  
14  
1ꢀ  
16  
—
11  
12  
13  
14  
EP  
No Connection. Not internally connected.  
2
I C-Co5patible Serial Clock Input  
2
I C-Co5patible Serial Data I/O  
Positive Supply Voltage. Bypass V+ to GND with a 0.047µF cera5ic capacitor.  
Exposed Pad. Connect exposed pad to GND.  
EP  
4
_______________________________________________________________________________________  
1234567...14

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