MAX7318AUG

更新时间： 2024-02-19 09:29:24

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描述
2-Wire-Interfaced, 16-Bit, I/O Port Expander with Interrupt and Hot-Insertion Protection

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MAX7318AUG 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	SOP, SOP24,.4	针数：	24
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.8
JESD-30 代码：	R-PDSO-G24	JESD-609代码：	e0
长度：	15.4 mm	湿度敏感等级：	1
位数：	16	I/O 线路数量：	16
端口数量：	1	端子数量：	24
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP24,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	240
电源：	2/5.5 V	认证状态：	Not Qualified
座面最大高度：	2.65 mm	子类别：	Parallel IO Port
最大供电电压：	5.5 V	最小供电电压：	2 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	BICMOS	温度等级：	AUTOMOTIVE
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7.5 mm
uPs/uCs/外围集成电路类型：	PARALLEL IO PORT, GENERAL PURPOSE	Base Number Matches：	1

MAX7318AUG 数据手册

2-Wire-Interfaced, 16-Bit, I/O Port Expander

with Interrupt and Hot-Insertion Protection

SDA

SCL

START

STOP

CONDITION

Figure 3. START and STOP Conditions

SDA

SCL

DATA LINE STABLE; DATA VALID CHANGE OF DATA ALLOWED

Figure 4. Bit Transfer

START CONDITION

SCL

CLOCK PULSE FOR ACKNOWLEDGMENT

SDA

BY TRANSMITTER

SDA

BY RECEIVER

Figure 5. Acknowledge

Each transmission consists of a START condition sent by

a master, followed by the MAX7318 7-bit slave address

plus R/W bit, a register address byte, 1 or more data

bytes, and finally a STOP condition (Figure 3).

Bit Transfer

One data bit is transferred during each clock pulse.

The data on SDA must remain stable while SCL is high

(Figure 4).

START and STOP Conditions

Both SCL and SDA remain high when the interface is

not busy. A master signals the beginning of a transmis-

sion with a START (S) condition by transitioning SDA

from high to low while SCL is high. When the master

has finished communicating with the slave, it issues a

STOP (P) condition by transitioning SDA from low to

high while SCL is high. The bus is then free for another

transmission (Figure 3).

Acknowledge

The acknowledge bit is a clocked 9th bit, which the

recipient uses as a handshake receipt of each byte of

data (Figure 5). Thus, each byte transferred effectively

requires 9 bits. The master generates the 9th clock

pulse, and the recipient pulls down SDA during the

acknowledge clock pulse, such that the SDA line is sta-

ble low during the high period of the clock pulse. When

the master is transmitting to the MAX7318, the MAX7318

_______________________________________________________________________________________

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型号	品牌	描述	获取价格	数据表
MAX7318AUG-T	MAXIM	Parallel I/O Port, 16-Bit, 16 I/O, BICMOS, PDSO24, 4.40 MM, MO-153AD, TSSOP-24	获取价格
MAX7318AWG	MAXIM	2-Wire-Interfaced, 16-Bit, I/O Port Expander with Interrupt and Hot-Insertion Protection	获取价格
MAX7318AWG+	MAXIM	2-Wire-Interfaced 16-Port I/O Expander with Interrupt	获取价格
MAX7318AWG-T	MAXIM	Parallel I/O Port, 16-Bit, 16 I/O, BICMOS, PDSO24, 0.300 INCH, MS-013AD, SOIC-24	获取价格
MAX7319	MAXIM	I2C Port Expander with Eight Inputs and Maskable Transition Detection	获取价格
MAX7319	ADI	I2C端口扩展器，具有8路输入，可屏蔽瞬态检测	获取价格

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