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MAX3863ETJ+T

更新时间： 2024-01-12 15:38:27
品牌 Logo 应用领域
美信 - MAXIM 接口集成电路
页数 文件大小 规格书
15页 400K
描述
Interface Circuit, BIPolar, ROHS COMPLIANT, TQFN-32

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MAX3863ETJ+T 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：QFN
包装说明：HVQCCN, LCC32,.2SQ,20针数：32
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.81
接口集成电路类型：INTERFACE CIRCUITJESD-30 代码：S-XQCC-N32
JESD-609代码：e3长度：5 mm
湿度敏感等级：1功能数量：1
端子数量：32最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装等效代码：LCC32,.2SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：3.3 V
认证状态：Not Qualified座面最大高度：0.8 mm
子类别：Display Drivers最大供电电压：3.6 V
最小供电电压：3.15 V标称供电电压：3.3 V
表面贴装：YES技术：BIPOLAR
温度等级：INDUSTRIAL端子面层：Tin (Sn)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：5 mmBase Number Matches：1

MAX3863ETJ+T 数据手册

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2.7Gbps Laser Driver with Modulation  
Compensation  
MAX863  
ELECTRICAL CHARACTERISTICS (continued)  
(V  
CC  
= +3.15V to +3.6V, T = -40°C to +85°C. Typical values are at V  
= +3.3V, I  
= 50mA, I = 40mA, T = +25°C, unless  
MOD A  
A
CC  
BIAS  
otherwise noted.) (Notes 1, 9)  
PARAMETER  
SYMBOL  
CONDITIONS  
MIN  
TYP  
MAX UNITS  
At high  
At low  
V
CC  
Single-Ended Input (DC-Coupled)  
Single-Ended Input (AC-Coupled)  
V
V
IS  
IS  
ID  
V
- 1.0  
V
- 0.1  
CC  
CC  
V
+
V
+
-
CC  
CC  
0.4  
At high  
At low  
0.05  
V
V
V
-
V
CC  
CC  
0.4  
0.05  
DC-coupled  
AC-coupled  
NRZ (Note 3)  
0.2  
0.2  
2.0  
1.6  
Differential Input Swing  
Input Data Rate  
V
V
P-P  
3.2  
17  
14  
Gbps  
dB  
f ≤ 2.7GHz  
2.7GHz < f ≤ 4GHz  
Input Return Loss  
RL  
(Notes 3, 5)  
IN  
Turn-Off Delay from EN  
Setup Time  
EN = high (Note 3)  
Figure 2 (Note 3)  
Figure 2 (Note 3)  
1.0  
µs  
ps  
ps  
ps  
ps  
t
90  
SU  
Hold Time  
t
90  
HD  
Pulse-Width Adjustment Range  
Pulse-Width Stability  
Z = 25Ω (Notes 3, 6)  
L
185  
220  
PWC+ and PWC- open (Notes 3, 6)  
18.5  
1.0  
Differential Pulse-Width Control  
Input Range  
For PWC+ and PWC- (Notes 3, 7), V = 0.5V  
-1.0  
V
V
CM  
Differential Mark Density  
0% to 100%, V + - V  
-
MK  
0.85  
MK  
Differential Mark-Density Voltage  
to Mark-Density Ratio  
15.5  
V/%  
Output Edge Speed  
Output Overshoot  
Random Jitter  
t , t  
R
Z = 25Ω (20% to 80%) (Notes 3, 6)  
50  
7
85  
ps  
%
F
L
δ
Z = 25Ω (Note 3)  
L
(Notes 3, 6)  
0.8  
8
1.3  
40  
40  
ps  
RMS  
Data Rate = 2.7Gbps (Notes 3, 8)  
Data Rate = 3.2Gbps (Notes 3, 8)  
Deterministic Jitter  
ps  
P-P  
10  
Note 1: Specifications at -40°C are guaranteed by design and characterization.  
Note 2: Excluding I , I , I , I , I , and I . Input clock and data are AC-coupled.  
BIAS MOD BIASMON MODMON FAIL  
PWC  
Note 3: Guaranteed by design and characterization.  
Note 4: An external capacitor at APCFILT1 and APCFILT2 is used to set the time constant.  
Note 5: For both data inputs DATA+, DATA- and clock inputs CLK+, CLK-.  
Note 6: Measured using a 2.7Gbps repeating 0000 0000 1111 1111 pattern.  
Note 7: For pulse width, PW = 100%: Rp = Rn = 500Ω (or open) or PWC+ = PWC- ≈ +0.5V. For PW > 100%: Rp > Rn or PWC+ >  
PWC-. For PW < 100%: Rp < Rn or PWC+ < PWC-.  
Note 8: Measured using a 213 - 1 PRBS with 80 zeros + 80 ones input data pattern or equivalent.  
Note 9: AC characterization performed using the circuit in Figure 1.  
Note 10: Power-Supply Noise Rejection (PSNR) = 20log (V  
/ΔV  
). V  
is the voltage across the 25Ω load when no  
10 NOISE (on VCC)  
OUT  
OUT  
input is applied.  
_______________________________________________________________________________________  
3
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