M61531FP

更新时间： 2024-02-14 09:24:28

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瑞萨 - RENESAS		音频控制集成电路消费电路商用集成电路电子
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20页	358K
描述
6ch Electronic Volume with 10 Input Selectors

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M61531FP 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	20 X 14 MM, 0.80 MM PITCH, PLASTIC, QFP-80	针数：	80
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.81
Is Samacsys：	N	其他特性：	IT ALSO REQUIRES 2.7V TO 5.5V DIGITAL SUPPLY
信道分离：	90 dB	商用集成电路类型：	TONE CONTROL CIRCUIT
谐波失真：	0.03%	JESD-30 代码：	R-PQFP-G80
长度：	20 mm	频带数量：	2
信道数量：	6	功能数量：	1
端子数量：	80	最高工作温度：	55 °C
最低工作温度：	-20 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	QFP	封装形状：	RECTANGULAR
封装形式：	FLATPACK	认证状态：	Not Qualified
座面最大高度：	3.05 mm	最大供电电压 (Vsup)：	7.5 V
最小供电电压 (Vsup)：	4.5 V	表面贴装：	YES
温度等级：	OTHER	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
宽度：	14 mm	Base Number Matches：	1

M61531FP 数据手册

M61531FP

Preliminary

Relationship between Data and Clock

LATCH SIGNAL

D23 D0

D21

D22

DATA

CLOCK

LATCH

DATA signal isread at the rising edge of CLOCK.

Serial data (D0 –D23) isloaded at the risingedge of theLATCH signal.

Clock and Data Timings

tSC

tcr

75%

CLOCK

25%

tWHC

tWLC

75%

25%

DATA

tWHC

tSD

tHD

tSL

75%

25%

LATCH

Timing Definition of Digital Block

Item

Symbol

t_cr

Min.

Typ.

Max.

Unit

µs

Clock cycle time

—

0.4

—

Clock pulse width (“H” level)

Clock pulse width (“L” level)

Rising time of clock,data and latch

Falling time of clock,data and latch

Data setup time

t_WHC

t_WLC

t_r

1.6

—

t_f

—

t_SD

0.8

Data hold time

t_HD

Latch setup time

t_SL

Latch pulse width

t_WHL

t_SC

1.6

Clock setup time

Rev.1.1, Jun.01.2004, page 5 of 19

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