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IS61LV3216-20TI

更新时间： 2024-01-31 00:23:18

品牌	Logo	应用领域
矽成 - ICSI		静态存储器光电二极管内存集成电路
页数	文件大小	规格书
8页	429K
描述
Standard SRAM, 32KX16, 20ns, CMOS, PDSO44,

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IS61LV3216-20TI 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	TSOP2	包装说明：	PLASTIC, TSOP2-44
针数：	44	Reach Compliance Code：	compliant
ECCN代码：	3A991.B.2.B	HTS代码：	8542.32.00.41
风险等级：	5.86	最长访问时间：	20 ns
I/O 类型：	COMMON	JESD-30 代码：	R-PDSO-G44
JESD-609代码：	e0	长度：	18.41 mm
内存密度：	524288 bit	内存集成电路类型：	STANDARD SRAM
内存宽度：	16	功能数量：	1
端口数量：	1	端子数量：	44
字数：	32768 words	字数代码：	32000
工作模式：	ASYNCHRONOUS	最高工作温度：	85 °C
最低工作温度：	-40 °C	组织：	32KX16
输出特性：	3-STATE	可输出：	YES
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSOP2
封装等效代码：	TSOP44,.46,32	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE	并行/串行：	PARALLEL
电源：	3.3 V	认证状态：	Not Qualified
座面最大高度：	1.2 mm	最大待机电流：	0.01 A
最小待机电流：	3 V	子类别：	SRAMs
最大压摆率：	0.18 mA	最大供电电压 (Vsup)：	3.63 V
最小供电电压 (Vsup)：	2.97 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	DUAL	宽度：	10.16 mm
Base Number Matches：	1

IS61LV3216-20TI 数据手册

IS61LV3216

WRITE CYCLE SWITCHING CHARACTERISTICS^(1,3)(Over Operating Range)

-10

Min.

-12

Min.

-15

Min.

-20

Min.

Symbol Parameter

Max.

—

Max.

—

Max.

—

Max.

—

Unit

tWC

tSCE

tAW

Write Cycle Time

CE to Write End

—

Address Setup Time

to Write End

—

tHA

Address Hold from Write End

Address Setup Time

—

tSA

tPWB

tPWE

tSD

LB, UB Valid to End of Write

WE Pulse Width

—

Data Setup to Write End

Data Hold from Write End

WE LOW to High-Z Output

WE HIGH to Low-Z Output

tHD

—

(2)

tHZWE

—

(2)

tLZWE

—

Notes:

1. Test conditions assume signal transition times of 3 ns or less, timing reference levels of 1.5V, input pulse levels of 0 to 3.0V

and output loading specified in Figure 1a.

2. Tested with the load in Figure 1b. Transition is measured ±500 mV from steady-state voltage. Not 100% tested.

3. The internal write time is defined by the overlap of CE LOW and UB or LB, and WE LOW. All signals must be in valid states to

initiate a Write, but any one can go inactive to terminate the Write. The Data Input Setup and Hold timing are referenced to the

rising or falling edge of the signal that terminates the write.

Integrated Circuit Solution Inc.

SR009-0B

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