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ICS889872AKLF

更新时间： 2024-09-30 04:44:23
品牌 Logo 应用领域
艾迪悌 - IDT 时钟驱动器逻辑集成电路
页数 文件大小 规格书
14页 1088K
描述
DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION

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ICS889872AKLF 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Obsolete零件包装代码：QFN
包装说明：HVQCCN,针数：16
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.84Is Samacsys：N
系列：889872输入调节：DIFFERENTIAL
JESD-30 代码：S-XQCC-N16JESD-609代码：e3
长度：3 mm逻辑集成电路类型：LOW SKEW CLOCK DRIVER
功能数量：1反相输出次数：
端子数量：16实输出次数：3
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260传播延迟（tpd）：0.75 ns
认证状态：Not Qualified座面最大高度：1 mm
最大供电电压 (Vsup)：2.625 V最小供电电压 (Vsup)：2.375 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：3 mm最小 fmax：2000 MHz
Base Number Matches：1

ICS889872AKLF 数据手册

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PRELIMINARY  
DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER  
W/INTERNAL TERMINATION  
ICS889872  
General Description  
Features  
The ICS889872 is a high speed Differential-to-  
• Three LVDS outputs  
S
IC  
LVDS Buffer/Divider w/Internal Termination and is a  
member of the HiPerClockS™family of high  
performance clock solutions from IDT. The  
• Frequency divide select options: ÷4, ÷6: >2GHz,  
HiPerClockS™  
÷8, ÷16: >1.6GHz  
• IN, nIN input can accept the following differential input levels:  
ICS889872 has a selectable ÷2, ÷4, ÷8, ÷16 output  
LVPECL, LVDS, CML  
dividers. The clock input has internal termination resistors,  
allowing it to interface with several differential signal types while  
minimizing the number of required external components. The  
device is packaged in a small, 3mm x 3mm VFQFN package,  
making it ideal for use on space-constrained boards.  
• Output frequency: >2GHz  
• Cycle-to-cycle jitter: 1ps (typical)  
• Total jitter: 10ps (typical)  
• Output skew: 7ps (typical), QA/nQA outputs  
• Part-to-part skew: 250ps (typical)  
• Propagation Delay: 750ps (typical), QA/nQA outputs  
• Full 2.5V supply mode  
• -40°C to 85°C ambient operating temperature  
• Available in both standard (RoHS 5) and lead-free (RoHS 6)  
packages  
Pin Assignment  
Block Diagram  
Enable  
16 15 14 13  
nRESET/  
FF  
1
2
3
QB0  
nQB0  
QB1  
12  
11  
10  
IN  
nDISABLE  
VT  
VREF_AC  
nIN  
Enable  
MUX  
QA  
nQB1  
4
9
5
6
7
8
nQA  
QB0  
IN  
50Ω  
nQB0  
÷2, ÷4,  
÷8, ÷16  
VT  
50Ω  
ICS889872  
nIN  
QB1  
16-Lead VFQFN  
3mm x 3mm x 0.95mm package body  
VREF_AC  
S1  
nQB1  
K Package  
Top View  
Decoder  
S0  
The Preliminary Information presented herein represents a product in pre-production. The noted characteristics are based on initial product characterization and/or qualification.  
Integrated Device Technology, Incorporated (IDT) reserves the right to change any circuitry or specifications without notice.  
IDT™ / ICS™ LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION  
1
ICS889872AK REV. A AUGUST 22, 2007  
1234567...14

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与ICS889872AKLF相关器件

型号 品牌 获取价格 描述 数据表
ICS889872AKLFT IDT

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 		DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
ICS889872AKT IDT

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 		DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
ICS889874 ICSI

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 		DIFFERENTIAL-TO-LVPECL BUFFER/DIVIDER
ICS889874AK ICSI

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 		DIFFERENTIAL-TO-LVPECL BUFFER/DIVIDER
ICS889874AKT ICSI

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 		DIFFERENTIAL-TO-LVPECL BUFFER/DIVIDER
ICS889875AKLFT IDT

获取价格

 		Low Skew Clock Driver, 889875 Series, 2 True Output(s), 0 Inverted Output(s), 3 X 3 MM, 0.
ICS889875AKT IDT

获取价格

 		Low Skew Clock Driver, 889875 Series, 2 True Output(s), 0 Inverted Output(s), 3 X 3 MM, 0.
ICS8M3001AJ IDT

获取价格

 		Low Skew Clock Driver, 1 True Output(s), 0 Inverted Output(s), CDSO6, 5 X 7 MM, 1.50 MM, C
ICS8M3001AJLF IDT

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