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HPMX-5002 PDF预览

HPMX-5002

更新时间： 2024-02-12 18:53:44
品牌 Logo 应用领域
安捷伦 - AGILENT 电信集成电路电信电路
页数 文件大小 规格书
14页 162K
描述
IF Modulator/Demodulator IC

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HPMX-5002 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：LFQFP, QFP48,.35SQ,20
针数：48Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.53
Is Samacsys：NJESD-30 代码：S-PQFP-G48
JESD-609代码：e0长度：7 mm
功能数量：1端子数量：48
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装等效代码：QFP48,.35SQ,20封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3/5 V认证状态：Not Qualified
座面最大高度：1.6 mm子类别：Other Telecom ICs
最大压摆率：0.027 mA标称供电电压：3 V
表面贴装：YES技术：BIPOLAR
电信集成电路类型：CORDLESS TELEPHONE BASEBAND CIRCUIT端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7 mmBase Number Matches：1

HPMX-5002 数据手册

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HPMX-5002 Pin Description  
No. Mnemonic  
I/O Type  
Analog O/P  
Analog I/P  
Analog O/P  
Analog I/P  
Analog O/P  
Analog DC  
CMOS I/P  
CMOS O/P  
Analog O/P  
Analog DC  
CMOS O/P  
Analog I/P  
DC Supply  
Ground  
Description  
1
2
IFOP1  
DMOD  
DMODOP  
BUF1  
BUF2  
TCNT  
TCSET  
DATOP  
RSSI  
Output of IF amplifier, feeds quadrature network for discriminator  
Input to discriminator mixer, driven by output of quadrature network  
Output of discriminator mixer, drives external low-pass data filter  
Noninverting input of buffer amplifier that drives the data slicer  
Output of buffer amplifer that drives the data slicer  
External capacitor connection which sets time constant for data slicer  
Data slicer time constant select  
3
4
5
6
7
8
Output bit stream from data slicer  
9
Receive Signal Strength Indicator output  
External capacitor connection which sets time constant for lock detector  
Indicates that LO2 PLL is in lock status  
Reference signal for LO2 PLL  
10  
11  
12  
13  
14  
15  
16  
17  
20  
21  
22  
23  
24  
25  
26  
27  
28  
29  
30  
31  
32  
33  
34  
35  
LKFIL  
LKDET  
REF  
VCC3  
VEE3  
DIV1  
PLL supply voltage  
PLL ground  
CMOS I/P  
CMOS I/P  
CMOS I/P  
Analog O/P  
Ground  
Controls divide ratio for reference frequency input to the LO2 PLL  
Controls divide ratio for reference frequency input to the LO2 PLL  
Controls divide ratio for VCO frequency input to the LO2 PLL  
LO2 PLL phase/frequency detector charge pump output  
LO2 VCO ground  
DIV2  
DIV3  
PFD  
VEE4  
VCC4  
AGC  
DC Supply  
Analog DC  
Analog I/P  
Analog O/P  
Analog I/P  
Analog O/P  
Analog O/P  
DC Supply  
Ground  
LO2 VCO supply voltage  
External capacitor connection to compensate LO2 VCO AGC loop  
VCO tank force line  
VCOA  
VCOB  
VCOADJ  
OSCOP  
OSCOPB  
VCC5  
VEE5  
IPDC  
VCO tank sense line  
Controls amplitude of buffered LO2 VCO output  
Buffered LO2 output (+)  
Buffered LO2 output (-)  
1st IF supply voltage  
1st IF ground  
Analog DC  
Analog I/P  
DC Supply  
Ground  
External capacitor connection for decoupling 1st IF bias point  
1st IF input signal  
IP1  
VCC1  
VEE1  
IF1  
IF limiting amplifier supply voltage  
IF limiting amplifier ground  
Analog O/P  
Downconverted signal from front-end mixer, drives external filter  
(hi-Z output, open collector)  
37  
IFIP1  
Analog I/P  
Input to IF limiting amplifier, driven by external filter  
(600 Ω impedance, internally set)  
38  
39  
40  
DC1A  
VCC2  
VEE2  
Analog DC  
DC Supply  
Ground  
External capacitor connection for decoupling IF limiting amplifier  
IF limiting amplifier supply voltage  
IF limiting amplifier ground  
7-109  
12345678...14

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