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HCS373MS PDF预览

HCS373MS

更新时间： 2024-01-24 04:05:13
品牌 Logo 应用领域
英特矽尔 - INTERSIL 锁存器
页数 文件大小 规格书
10页 186K
描述
Radiation Hardened Octal Transparent Latch, Three-State

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HCS373MS 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DFP包装说明：DFP, FL20,.3
针数：20Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.18
Is Samacsys：N系列：HC/UH
JESD-30 代码：R-CDFP-F20JESD-609代码：e0
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.006 A位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：DFP封装等效代码：FL20,.3
封装形状：RECTANGULAR封装形式：FLATPACK
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
Prop。Delay @ Nom-Sup：24 ns认证状态：Not Qualified
筛选级别：MIL-PRF-38535 Class T座面最大高度：2.92 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：FLAT端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
总剂量：100k Rad(Si) V宽度：6.92 mm
Base Number Matches：1

HCS373MS 数据手册

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HCS373MS  
Radiation Hardened  
Octal Transparent Latch, Three-State  
September 1995  
Features  
Pinouts  
20 LEAD CERAMIC DUAL-IN-LINE  
METAL SEAL PACKAGE (SBDIP)  
MIL-STD-1835 CDIP2-T20  
TOP VIEW  
• 3 Micron Radiation Hardened CMOS SOS  
• Total Dose 200K RAD (Si)  
• SEP Effective LET No Upsets: >100 MEV-cm2/mg  
1
2
3
4
5
6
7
8
9
VCC  
Q7  
OE  
Q0  
D0  
D1  
Q1  
Q2  
D2  
D3  
Q3  
20  
19  
• Single Event Upset (SEU) Immunity < 2 x 10-9 Errors/Bit-  
Day (Typ)  
18 D7  
17 D6  
16 Q6  
• Dose Rate Survivability: >1 x 1012 RAD (Si)/s  
• Dose Rate Upset >1010 RAD (Si)/s 20ns Pulse  
• Latch-Up Free Under Any Conditions  
15  
Q5  
14 D5  
13 D4  
• Military Temperature Range: -55oC to +125oC  
• Significant Power Reduction Compared to LSTTL ICs  
• DC Operating Voltage Range: 4.5V to 5.5V  
12  
Q4  
GND 10  
11 LE  
• Input Logic Levels  
- VIL = 0.3 VCC Max  
- VIH = 0.7 VCC Min  
• Input Current Levels Ii ≤ 5µA at VOL, VOH  
20 LEAD CERAMIC METAL SEAL  
FLATPACK PACKAGE (FLATPACK)  
MIL-STD-1835 CDFP4-F20  
TOP VIEW  
Description  
The Intersil HCS373MS is a Radiation Hardened octal transpar-  
ent three-state latch with an active-low output enable. The  
HCS373MS utilizes advanced CMOS/SOS technology. The out-  
puts are transparent to the inputs when the Latch Enable (LE) is  
HIGH. When the Latch Enable (LE) goes LOW, the data is  
latched. The Output Enable (OE) controls the three-state outputs.  
When the Output Enable (OE) is HIGH, the outputs are in the  
high impedance state. The latch operation is independent of the  
state of the Output Enable.  
OE  
Q0  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
17  
16  
15  
14  
13  
12  
11  
VCC  
Q7  
D7  
D6  
Q6  
Q5  
D5  
D4  
Q4  
LE  
D0  
D1  
Q1  
Q2  
D2  
D3  
The HCS373MS utilizes advanced CMOS/SOS technology to  
achieve high-speed operation. This device is a member of  
radiation hardened, high-speed, CMOS/SOS Logic Family.  
Q3  
GND  
The HCS373MS is supplied in a 20 lead Ceramic flatpack  
(K suffix) or a SBDIP Package (D suffix).  
Ordering Information  
PART NUMBER  
HCS373DMSR  
TEMPERATURE RANGE  
SCREENING LEVEL  
Intersil Class S Equivalent  
Intersil Class S Equivalent  
Sample  
PACKAGE  
o
o
-55 C to +125 C  
20 Lead SBDIP  
o
o
HCS373KMSR  
-55 C to +125 C  
20 Lead Ceramic Flatpack  
20 Lead SBDIP  
o
HCS373D/Sample  
HCS373K/Sample  
HCS373HMSR  
+25 C  
o
+25 C  
Sample  
20 Lead Ceramic Flatpack  
Die  
o
+25 C  
Die  
CAUTION: These devices are sensitive to electrostatic discharge; follow proper IC Handling Procedures.  
Spec Number 518845  
File Number 2135.2  
1-888-INTERSIL or 321-724-7143 | Copyright © Intersil Corporation 1999  
346  
1234567...10

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型号 品牌 获取价格 描述 数据表
HCS373T INTERSIL

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