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FS6345-02

更新时间： 2024-02-29 05:20:21
品牌 Logo 应用领域
安森美 - ONSEMI 光电二极管
页数 文件大小 规格书
1页 14K
描述
28.224MHz, OTHER CLOCK GENERATOR, PDSO20, SOIC-20

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FS6345-02 技术参数

生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP,针数：20
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.8
JESD-30 代码：R-PDSO-G20长度：12.8 mm
端子数量：20最大输出时钟频率：28.224 MHz
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
主时钟/晶体标称频率：13.5 MHz认证状态：Not Qualified
座面最大高度：2.65 mm标称供电电压：5 V
表面贴装：YES技术：CMOS
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL宽度：7.5 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHERBase Number Matches：1

FS6345-02 数据手册

  
FS6345  
AMERICAN MICROSYSTEMS, INC  
Triple PLL VCXO Clock Generator IC  
1.0 Features  
2.0 Description  
The FS6345 is a monolithic CMOS clock generator IC  
designed to minimize cost and component count in digital  
video/audio systems.  
•
On-chip tunable voltage-controlled crystal oscillator  
circuitry (VCXO) allows precise system frequency  
tuning (pull range typically 300ppm)  
At the core of the FS6345 is circuitry that implements a  
voltage-controlled crystal oscillator when an external  
resonator is attached. The VCXO allows device frequen-  
cies to be precisely adjusted for use in systems that have  
frequency matching requirements, such as digital satellite  
receivers.  
•
•
•
VCXO tuning range: 0-3V  
Uses inexpensive fundamental-mode crystals  
Two integrated phase-locked loops (PLL) multiply  
VCXO frequency to the higher system frequencies  
needed  
•
•
•
•
5V core supply voltage (contact factory for 3.3V)  
3.3V / 5V output supply voltage  
Three high-resolution phase-locked loops generate the  
output clock frequencies (CLKA, CLKB, and CLKC).  
These frequencies are phase-locked and frequency-  
locked to the VCXO frequency. Synthesis error of the  
PLLs is +/-0 ppm unless otherwise noted.  
Small circuit board footprint (20-pin SOIC)  
Custom frequency selections available - contact your  
local AMI Sales Representative for more information  
Figure 1: Pin Configuration  
Table 1: Crystal / Output Frequencies  
1
20  
19  
18  
17  
16  
15  
14  
13  
12  
11  
n/c  
n/c  
DEVICE  
fXIN (MHz) CLKA (MHz) CLKB (MHz) CLKC (MHz)  
2
XOUT  
n/c  
FS6345-02  
13.500 28.224 18.432 27.000  
3
XIN  
CLKC  
n/c  
NOTE: Contact AMI for custom PLL frequencies  
4
VDD  
5
XTUNE  
n/c  
n/c  
VSS  
OE  
6
7
VDDO  
VSS  
CLKB  
n/c  
8
9
CLKA  
n/c  
10  
n/c  
Figure 2: Block Diagram  
XIN  
CLKA  
VCXO  
PLL  
XOUT  
CLKB  
CLKC  
Divider  
Array  
XTUNE  
PLL  
PLL  
FS6345  
This document contains information on a preproduction product. Specifications and information herein are subject to change without notice.  
3.13.01  
ISO9001  
1

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