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EPF10K100EQC240-2N

更新时间： 2023-01-15 00:00:00

品牌	Logo	应用领域
阿尔特拉 - ALTERA		时钟 LTE 栅可编程逻辑
页数	文件大小	规格书
110页	1604K
描述
Loadable PLD, 0.5ns, CMOS, PQFP240, 34.60 X 34.60 MM, 0.50 MM PITCH, PLASTIC, QFP-240

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EPF10K100EQC240-2N 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
包装说明：	FQFP, QFP240,1.3SQ,20	Reach Compliance Code：	compliant
ECCN代码：	3A991	HTS代码：	8542.39.00.01
风险等级：	5.34	其他特性：	4992 LOGIC ELEMENTS
最大时钟频率：	140 MHz	JESD-30 代码：	S-PQFP-G240
JESD-609代码：	e3	长度：	32 mm
湿度敏感等级：	3	I/O 线路数量：	189
输入次数：	189	逻辑单元数量：	4992
输出次数：	189	端子数量：	240
最高工作温度：	70 °C	最低工作温度：
组织：	189 I/O	输出函数：	MIXED
封装主体材料：	PLASTIC/EPOXY	封装代码：	FQFP
封装等效代码：	QFP240,1.3SQ,20	封装形状：	SQUARE
封装形式：	FLATPACK, FINE PITCH	峰值回流温度（摄氏度）：	245
电源：	2.5,2.5/3.3 V	可编程逻辑类型：	LOADABLE PLD
传播延迟：	0.5 ns	认证状态：	Not Qualified
座面最大高度：	4.1 mm	子类别：	Field Programmable Gate Arrays
最大供电电压：	2.625 V	最小供电电压：	2.375 V
标称供电电压：	2.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	40	宽度：	32 mm

EPF10K100EQC240-2N 数据手册

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FLEX 10KE

Embedded Programmable

Logic Device

January 2003, ver. 2.5

Data Sheet

■

Embedded programmable logic devices (PLDs), providing

system-on-a-programmable-chip (SOPC) integration in a single

device

Features...

–

Enhanced embedded array for implementing megafunctions

such as efficient memory and specialized logic functions

Dual-port capability with up to 16-bit width per embedded array

block (EAB)

Logic array for general logic functions

■

High density

–

30,000 to 200,000 typical gates (see Tables 1 and 2)

Up to 98,304 RAM bits (4,096 bits per EAB), all of which can be

used without reducing logic capacity

System-level features

–

MultiVolt^TMI/ O pins can drive or be driven by 2.5-V, 3.3-V, or

5.0-V devices

–

Low power consumption

Bidirectional I/ O performance (t_SUand t_CO) up to 212 MHz

Fully compliant with the PCI Special Interest Group (PCI SIG)

PCI Local Bus Specification, Revision 2.2 for 3.3-V operation at

33 MHz or 66 MHz

–

-1 speed grade devices are compliant with PCI Local Bus

Specification, Revision 2.2, for 5.0-V operation

Built-in Joint Test Action Group (JTAG) boundary-scan test

(BST) circuitry compliant with IEEE Std. 1149.1-1990, available

without consuming additional device logic

For information on 5.0-V FLEX^®10K or 3.3-V FLEX 10KA devices, see the

FLEX 10K Embedded Programmable Logic Family Data Sheet.

Table 1. FLEX 10KE Device Features

Feature

EPF10K30E

EPF10K50E

EPF10K50S

Typical gates (1)

Maximum system gates

Logic elements (LEs)

EABs

30,000

119,000

1,728

50,000

199,000

2,880

Total RAM bits

24,576

220

40,960

254

Maximum user I/O pins

Altera Corporation

DS-F10KE-2.5

12 3 4 5 6 7...110

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EPF10K100EQC240-2N 替代型号

型号	品牌	替代类型	描述	数据表
EP1K100QC208-2N	ALTERA	功能相似	Loadable PLD, 0.5ns, CMOS, PQFP208, PLASTIC, QFP-208

与EPF10K100EQC240-2N相关器件

型号	品牌	获取价格	描述	数据表
EPF10K100EQC240-2X	ETC	获取价格	Field Programmable Gate Array (FPGA)
EPF10K100EQC240-2XN	ALTERA	获取价格	Loadable PLD, 0.5ns, CMOS, PQFP240, 34.60 X 34.60 MM, 0.50 MM PITCH, PLASTIC, QFP-240
EPF10K100EQC240-3	ALTERA	获取价格	Loadable PLD, 0.7ns, CMOS, PQFP240, 34.60 X 34.60 MM, 0.50 MM PITCH, PLASTIC, QFP-240
EPF10K100EQC240-3DX	ETC	获取价格	ASIC
EPF10K100EQC240-3N	ALTERA	获取价格	Loadable PLD, 0.7ns, CMOS, PQFP240, 34.60 X 34.60 MM, 0.50 MM PITCH, PLASTIC, QFP-240
EPF10K100EQC240-3X	ALTERA	获取价格	Loadable PLD, 0.7ns, CMOS, PQFP240, 34.60 X 34.60 MM, 0.50 MM PITCH, PLASTIC, QFP-240
EPF10K100EQI208-1DX	ETC	获取价格	ASIC
EPF10K100EQI208-2	ETC	获取价格	Field Programmable Gate Array (FPGA)
EPF10K100EQI208-2DX	ETC	获取价格	ASIC
EPF10K100EQI208-2N	ALTERA	获取价格	Loadable PLD, 0.5ns, CMOS, PQFP208, 30.60 X 30.60 MM, 0.50 MM PITCH, PLASTIC, QFP-208

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