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DS32ELX0421

更新时间： 2024-02-15 10:05:35
品牌 Logo 应用领域
美国国家半导体 - NSC 双倍数据速率
页数 文件大小 规格书
26页 537K
描述
125 - 312.5 MHz Serializer with DDR LVDS Parallel LVDS Interface

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DS32ELX0421 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Obsolete包装说明：HVQCCN, LCC48,.27SQ,20
Reach Compliance Code：compliantECCN代码：5A991.B.1
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：5.62差分输出：YES
驱动器位数：2输入特性：DIFFERENTIAL
接口集成电路类型：LINE DRIVER接口标准：EIA-644; TIA-644
JESD-30 代码：S-XQCC-N48JESD-609代码：e3
长度：7 mm湿度敏感等级：3
功能数量：2端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装等效代码：LCC48,.27SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
电源：2.5,3.3 V认证状态：Not Qualified
最大接收延迟：座面最大高度：0.8 mm
子类别：Line Driver or Receivers最大压摆率：152 mA
最大供电电压：3.465 V最小供电电压：3.135 V
标称供电电压：3.3 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7 mmBase Number Matches：1

DS32ELX0421 数据手册

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July 29, 2008  
DS32EL0421, DS32ELX0421  
125 – 312.5 MHz Serializer with DDR LVDS Parallel LVDS  
Interface  
General Description  
The DS32EL0421/DS32ELX0421 is a 125 MHz to 312.5 MHz  
(DDR) serializer for high-speed serial transmission over FR-4  
printed circuit board backplanes, balanced cables, and optical  
fiber. This easy-to-use chipset integrates advanced signal  
and clock conditioning functions, with an FPGA friendly inter-  
face.  
Features  
5-bit LVDS parallel data interface  
■
■
■
■
■
■
Programmable transmit de-emphasis  
Configurable output levels (VOD  
)
Selectable DC-balanced encoder  
Selectable data scrambler  
Remote Sense for automatic detection and negotiation of  
link status  
The DS32EL0421/DS32ELX0421 serializes up to 5 parallel  
input LVDS channels to create a maximum data payload of  
3.125 Gbps. If the integrated DC-balance encoding is en-  
abled, the maximum data payload achievable is 2.5 Gbps.  
On chip LC VCOs  
■
■
■
Redundant serial output (ELX device only)  
The DS32EL0421/DS32ELX0421 serializers feature remote  
sense capability to automatically detect and negotiate link  
status with its companion DS32EL0124/DS32ELX0124 de-  
serializers without requiring an additional feedback path.  
Data valid signaling to assist with synchronization of  
multiple receivers  
Supports AC- and DC-coupled signaling  
Integrated CML and LVDS terminations  
Configurable PLL loop bandwidth  
Programmable output termination (50Ω or 75Ω).  
Built-in test pattern generator  
■
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■
■
The parallel LVDS interface reduces FPGA I/O pins, board  
trace count and alleviates EMI issues, when compared to tra-  
ditional single-ended wide bus interfaces.  
The DS32EL0421/DS32ELX0421 is programmable through  
a SMBus interface as well as through control pins.  
Loss of lock and error reporting  
Configurable via SMBus  
Target Applications  
48-pin LLP package with exposed DAP  
Imaging: Industrial, Medical Security, Printers  
■
■
■
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■
Displays: LED walls, Commercial  
Key Specifications  
Video Transport  
1.25 to 3.125 Gbps serial data rate  
■
■
■
■
Communication Systems  
125 to 312.5 MHz DDR parallel clock  
Test and Measurement  
-40° to +85°C temperature range  
Industrial Bus  
>8 kV ESD (HBM) protection  
Low Intrinsic Jitter — 35ps at 3.125 Gbps  
■
Typical Application  
30032101  
© 2008 National Semiconductor Corporation  
300321  
www.national.com  
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型号 品牌 获取价格 描述 数据表
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