DM74LS75M

更新时间： 2024-01-15 09:12:44

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飞兆/仙童 - FAIRCHILD		触发器锁存器逻辑集成电路光电二极管
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5页	53K
描述
Quad Latch

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DM74LS75M 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	0.150 INCH, MS-012, SOIC-16
针数：	16	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.27
Is Samacsys：	N	系列：	LS
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e0
长度：	9.9 mm	逻辑集成电路类型：	D LATCH
最大I（ol）：	0.008 A	位数：	2
功能数量：	2	端子数量：	16
最高工作温度：	70 °C	最低工作温度：
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP16,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	5 V
最大电源电流（ICC）：	12 mA	Prop。Delay @ Nom-Sup：	30 ns
传播延迟（tpd）：	30 ns	认证状态：	Not Qualified
座面最大高度：	1.75 mm	子类别：	FF/Latches
最大供电电压 (Vsup)：	5.25 V	最小供电电压 (Vsup)：	4.75 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	TTL	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	触发器类型：	HIGH LEVEL
宽度：	3.9 mm	Base Number Matches：	1

DM74LS75M 数据手册

August 1986

Revised March 2000

DM74LS75

Quad Latch

General Description

These latches are ideally suited for use as temporary stor-

age for binary information between processing units and

input/output or indicator units. Information present at a data

(D) input is transferred to the Q output when the enable is

HIGH, and the Q output will follow the data input as long as

the enable remains HIGH. When the enable goes LOW, the

information (that was present at the data input at the time

the transition occurred) is retained at the Q output until the

enable is permitted to go HIGH.

These latches feature complementary Q and Q outputs

from a 4-bit latch, and are available in 16-pin packages.

Ordering Code:

Order Number Package Number

Package Description

DM74LS75M

DM74LS75N

M16A

N16E

16-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150 Narrow

16-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide

Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.

Logic Diagram

Connection Diagram

(Each Latch)

Function Table (Each Latch)

Inputs

Enable

Outputs

Q₀

H = HIGH Level

L = LOW Level

X = Don't Care

= The Level of Q Before the HIGH-to-LOW Transition of ENABLE

DS006374

www.fairchildsemi.com

12 3 4 5

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与DM74LS75M相关器件

型号	品牌	获取价格	描述	数据表
DM74LS75MX	FAIRCHILD	获取价格	4-Bit D-Type Latch
DM74LS75N	FAIRCHILD	获取价格	Quad Latch
DM74LS75N	TI	获取价格	LS SERIES, DUAL HIGH LEVEL TRIGGERED D LATCH, COMPLEMENTARY OUTPUT, PDIP16
DM74LS75N/A+	TI	获取价格	IC,LATCH,SINGLE,4-BIT,LS-TTL,DIP,16PIN,PLASTIC
DM74LS75N/B+	TI	获取价格	IC,LATCH,SINGLE,4-BIT,LS-TTL,DIP,16PIN,PLASTIC
DM74LS76A	TI	获取价格	J-K FLIP-FLOP, PDIP16, DIP-16
DM74LS76AN	TI	获取价格	IC,FLIP-FLOP,DUAL,J/K TYPE,LS-TTL,DIP,16PIN,PLASTIC
DM74LS76AN/A+	TI	获取价格	IC,FLIP-FLOP,DUAL,J/K TYPE,LS-TTL,DIP,16PIN,PLASTIC
DM74LS76AN/B+	ETC	获取价格	J-K-Type Flip-Flop
DM74LS76J	TI	获取价格	IC IC,FLIP-FLOP,DUAL,J/K TYPE,LS-TTL,DIP,16PIN,CERAMIC, FF/Latch

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