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Datasheet > 微控制器和处理器 > 时钟发生器> CY25404ZXC-XXXT

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CY25404ZXC-XXXT

更新时间： 2024-10-01 09:41:27

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		晶体时钟发生器微控制器和处理器外围集成电路光电二极管
页数	文件大小	规格书
13页	205K
描述
Quad PLL Programmable Clock Generator with Spread Spectrum

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CY25404ZXC-XXXT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP20,.25	针数：	20
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.23
Is Samacsys：	N	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e3	长度：	6.5 mm
湿度敏感等级：	3	端子数量：	20
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	166 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP20,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	2.5/3.3 V
主时钟/晶体标称频率：	48 MHz	认证状态：	Not Qualified
座面最大高度：	1.1 mm	子类别：	Clock Generators
最大供电电压：	3.6 V	最小供电电压：	2.25 V
标称供电电压：	2.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

CY25404ZXC-XXXT 数据手册

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CY25404

Quad PLL Programmable Clock Generator

with Spread Spectrum

Features

■ Four fully integrated phase-locked loops (PLLs)

■ Commercial and Industrial temperature ranges

■ Input frequency range

❐ External crystal: 8 to 48 MHz

❐ External reference: 8 to 166 MHz clock

Benefits

■ Multiple high performance PLLs allow synthesis of unrelated

frequencies

■ Wide operating output frequency range

❐ 3 to 166 MHz

■ Nonvolatile programming for personalization of PLL

frequencies,spreadspectrumcharacteristics,drivestrength,

crystal load capacitance, and output frequencies

■ Programmable spread spectrum with center and down

spread option and lexmark and linear modulation profiles

■ Application specific programmable electromagnetic

interference (EMI) reduction using spread spectrum for

clocks

■ Selectable V_DDsupply voltage options:

❐ 2.5 V, 3.0 V, and 3.3 V

■ Selectableoutputclockvoltages,independentofV_DDsupply:

❐ 2.5 V, 3.0 V, and 3.3 V

■ Programmable PLLs for system frequency margin tests

■ Meets critical timing requirements in complex system

designs

■ Frequency select feature with option to select eight different

frequencies over nine clock outputs

■ Suitability for PC, consumer, portable, and networking

applications

■ Output enable, and SS ON/OFF controls

■ Low jitter, high accuracy outputs

■ Capable of zero parts per million (PPM) frequency synthesis

error

■ Ability to synthesize nonstandard frequencies with

Fractional-N capability

■ Uninterrupted system operation during clock frequency

switch

■ Up to nine clock outputs with programmable drive strength

■ Glitch-free outputs while frequency switching

■ 20-pin TSSOP package

■ Application compatibility in standard and low power systems

Block Diagram

CLK1

Crossbar

XIN/

EXCLKIN

Bank

1

CLK2

Switch

OSC

Output

PLL1

PLL2

CLK3

CLK4

CLK5

CLK6

CLK7

CLK8

CLK9

XOUT

Dividers

and

Bank

2

MUX

and

Drive

FS 0

FS 1

FS 2

Strength

Control

Bank

3

Control

Logic

PLL3

(SS)

PLL4

(SS)

OE

SSON

Cypress Semiconductor Corporation

Document #: 001-43258 Rev. *C

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised July 11, 2011

12 3 4 5 6 7...13

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