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BU2152FS-E1

更新时间： 2024-01-30 13:11:53

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罗姆 - ROHM		驱动光电二极管接口集成电路
页数	文件大小	规格书
25页	1047K
描述
SIPO Based Peripheral Driver, 0.025A, PDSO32, ROHS COMPLIANT, SSOP-32

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BU2152FS-E1 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SSOP
包装说明：	SSOP,	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.63
接口集成电路类型：	SIPO BASED PERIPHERAL DRIVER	JESD-30 代码：	R-PDSO-G32
JESD-609代码：	e2	长度：	13.6 mm
功能数量：	1	端子数量：	32
最高工作温度：	85 °C	最低工作温度：	-25 °C
输出电流流向：	SINK	标称输出峰值电流：	0.025 A
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	1.9 mm	最大供电电压：	5.5 V
最小供电电压：	2.7 V	标称供电电压：	5 V
表面贴装：	YES	温度等级：	OTHER
端子面层：	TIN COPPER	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	10	宽度：	5.4 mm
Base Number Matches：	1

BU2152FS-E1 数据手册

【BU2092F/FV】

●Pin descriptions

Pin No.

Pin Name

I/O

Function

V_SS

DATA

CLOCK

LCK

GND

Serial Data Input

Shift clock of DATA (Rising Edge Trigger)

Latch clock of DATA (Rising Edge Trigger)

Parallel Data Output (Nch Open Drain FET)

5～11,

Latch Data

Output FET

Q0～Q11

14～18

OFF

12, 13

N.C.

Non connected

Output Enable (“H” level : output FET is OFF)

Power Supply

V_DD

●Timing chart

CLOCK

DATA11

DATA10

DATA9

DATA1

DATA0

DATA

LCK

“H”

Previous DATA

DATA11～0

Note) Diagram shows a status where a pull-up resistor is connected to output.

Fig. 4

1. After the power is turned on and the voltage is stabilized, LCK should be activated, after clocking 12 data bits into

the DATA terminal.

2. Qx parallel output data of the shift register is set after the 12^thclock by the LCK.

3. Since the LCK is a label latch, data is retained in the “L” section and renewed in the “H” section of the LCK.

4. Data retained in the internal latch circuit is output when the OE is in the “L” section.

［Truth Table］

Input

Function

CLOCK

DATA

LCK

Output (Q0～Q11) Disable

Output (Q0～Q11) Enable

Store “L” in the first stage data of shift register, the previous stage data in the

others. (The conditions of storage register and output have no change.)

Store “H” in the first stage data of shift register, the previous stage data in the

others. (The conditions of storage register and output have no change.)

The data of shift register has no change.

The data of shift register is transferred to the storage register.

The data of storage register has no change.

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