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ATF16V8BQL-15JU

更新时间： 2024-01-01 14:05:24

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爱特美尔 - ATMEL		可编程逻辑器件输入元件异步传输模式 PC ATM 时钟
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26页	641K
描述
Industry-standard Architecture Emulates Mary 20-pin PAL

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ATF16V8BQL-15JU 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Transferred	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP20,.25	针数：	20
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.31.00.01	风险等级：	7.62
Is Samacsys：	N	架构：	PAL-TYPE
最大时钟频率：	45 MHz	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e3	长度：	6.5 mm
湿度敏感等级：	2	专用输入次数：	8
I/O 线路数量：	8	输入次数：	18
输出次数：	8	产品条款数：	64
端子数量：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	组织：	8 DEDICATED INPUTS, 8 I/O
输出函数：	MACROCELL	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP20,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	5 V
可编程逻辑类型：	FLASH PLD	传播延迟：	15 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	Programmable Logic Devices	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	40
宽度：	4.4 mm	Base Number Matches：	1

ATF16V8BQL-15JU 数据手册

ATF16V8B/BQ/BQL

4.6

Power-up Reset

The registers in the ATF16V8Bs are designed to reset during power-up. At a point delayed

slightly from V_CCcrossing V_RST, all registers will be reset to the low state. As a result, the regis-

tered output state will always be high on power-up.

This feature is critical for state machine initialization. However, due to the asynchronous nature

of reset and the uncertainty of how V_CCactually rises in the system, the following conditions are

required:

1. The V_CCrise must be monotonic,

2. After reset occurs, all input and feedback setup times must be met before driving the

clock pin high, and

3. The clock must remain stable during t_PR

Figure 4-1. Power-up Reset Waveforms

Table 4-2.

Parameter

Power-up Reset Parameters

Description

Typ

Max

Units

Power-up

Reset Time

t_PR

600

1,000

Power-up

Reset Voltage

V_RST

3.8

4.5

4.7

Preload of Registered Outputs

The ATF16V8B’s registers are provided with circuitry to allow loading of each register with either

a high or a low. This feature will simplify testing since any state can be forced into the registers

to control test sequencing. A JEDEC file with preload is generated when a source file with vec-

tors is compiled. Once downloaded, the JEDEC file preload sequence will be done automatically

by most of the approved programmers after the programming.

5. Security Fuse Usage

A single fuse is provided to prevent unauthorized copying of the ATF16V8B fuse patterns. Once

programmed, fuse verify and preload are inhibited. However, the 64-bit User Signature remains

accessible.

The security fuse should be programmed last, as its effect is immediate.

0364J–PLD–7/05

1...4 5 678 9 10...26

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型号	品牌	描述	获取价格	数据表
ATF16V8BQL-15PC	ATMEL	High- Performance Flash PLD	获取价格
ATF16V8BQL-15PI	ATMEL	Industry-standard Architecture Emulates Mary 20-pin PAL	获取价格
ATF16V8BQL-15PJ	ATMEL	暂无描述	获取价格
ATF16V8BQL-15PL	ATMEL	Flash PLD, 15ns, CMOS, PDIP20, 0.300 INCH, PLASTIC, MS-001AD, DIP-20	获取价格
ATF16V8BQL-15PU	ATMEL	Industry-standard Architecture Emulates Mary 20-pin PAL	获取价格
ATF16V8BQL-15SC	ATMEL	High- Performance Flash PLD	获取价格

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