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AT71200MCRERE

更新时间： 2024-01-25 07:55:39
品牌 Logo 应用领域
爱特美尔 - ATMEL 传感器图像传感器
页数 文件大小 规格书
19页 270K
描述
8M-pixel Color Image Sensor

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AT71200MCRERE 技术参数

生命周期：Active零件包装代码：PGA
包装说明：PGA-88针数：88
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.09Is Samacsys：N
模拟集成电路 - 其他类型：ANALOG CIRCUITJESD-30 代码：R-CPGA-P88
长度：50.6 mm功能数量：1
端子数量：88最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：WPGA封装形状：RECTANGULAR
封装形式：GRID ARRAY, WINDOW认证状态：Not Qualified
座面最大高度：4.92 mm最大供电电压 (Vsup)：15.5 V
最小供电电压 (Vsup)：14.5 V标称供电电压 (Vsup)：15 V
表面贴装：NO温度等级：INDUSTRIAL
端子形式：PIN/PEG端子节距：2.54 mm
端子位置：PERPENDICULAR宽度：38 mm
Base Number Matches：1

AT71200MCRERE 数据手册

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AT71200M  
Absolute Maximum Ratings*  
Storage Temperature Range......................... -55°C to +150°C  
Operating Temperature Range........................ -40°C to +85°C  
Thermal Cycling..........................................................15°C/mn  
*NOTICE:  
Stresses above those listed under Absolute Maximum Ratings may cause permanent device failure. Functionality at or  
above these limits is not implied. Exposure to absolute maximum ratings for extended periods may affect device reliabil-  
ity.  
Electrical limits of applied signals are given in Table 5.  
Shorting the video output to VSS or VDD, even temporarily, can permanently damage the output amplifier.  
Due to MPP mode or negative voltages, image zone gates and region of interest gates do not include ESD protection.  
To avoid degradation, the devices (including pins and package) should be handled with a grounded bracelet and stored  
on conductive layer used for shipment.  
Table 5. Maximum Applied Voltages(1)  
Signal Name  
ΦLA[1:8]  
ΦLB[1:8]  
ΦS[1:4]  
Parameter  
Min  
Max  
Unit  
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
Readout A Register Clocks  
Readout B Register Clocks  
Summing Gate  
-0.3  
+15  
-0.3  
+15  
-0.3  
+15  
VGL[1:4]  
VGS[1:4]  
VOS[1:4]  
VDD[1:4]  
VS[1:4]  
Readout Gate  
-0.3  
+15  
Output Gate  
-0.3  
+15  
Output Video Signal  
Amplifier Drain Supply  
Source Bias  
-0.3  
+15  
-0.3  
-0.3  
+15  
+15  
ΦR[1:4]  
Reset Gate  
-0.3  
+15  
VDR[1:4]  
ΦPA[1:4]  
ΦPB[1:4]  
ΦPC[1:4]  
ΦPD[1:4]  
ΦTA  
Reset Bias  
-0.3  
+15  
Image Zone A Clocks  
Image Zone B Clocks  
Image Zone C Clocks  
Image Zone D Clocks  
Transfer Gates Zone A  
Transfer Gates Zone B  
Shield Drains  
-15 and ΦPA[other] - 20  
-15 and ΦPB[other] - 20  
-15 and ΦPC[other] - 20  
-15 and ΦPD[other] - 20  
ΦLA - 15 and ΦPA[4] - 15  
ΦLB - 15 and ΦPD[4 ] - 15  
-0.3  
+15 and ΦPA[other] + 20  
+15 andΦPB[other] + 20  
+15 and ΦPC[1:4] + 20  
+15 and ΦPD[other] + 20  
+15 and ΦPA[4] + 15  
ΦTB  
+15 and ΦPD[4] + 15  
VDEA, VDEB  
VFCA, VFCB  
ΦFCA  
+15  
+15  
+15  
+15  
0
Region Of Interest Drains  
Region Of Interest Gates Zone A  
Region Of Interest Gates Zone B  
Substrate Bias  
-0.3  
ΦLA[1:8] - 15  
ΦFCB  
ΦLB[1:8] - 15  
VSS  
Note:  
1. If not specified, all voltages are applied with respect to the substrate VSS.  
7
2133A–IMAGE–02/03  
1...45678910...19

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