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Datasheet > 微控制器和处理器 > 时钟发生器> ASM3I2508AG-08SR
ASM3I2508AG-08SR PDF预览

ASM3I2508AG-08SR

更新时间： 2024-02-16 10:40:13
品牌 Logo 应用领域
PULSECORE 晶体时钟发生器微控制器和处理器外围集成电路光电二极管
页数 文件大小 规格书
9页 396K
描述
Peak EMI Reducing Solution

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ASM3I2508AG-08SR 技术参数

生命周期：Obsolete包装说明：0.150 INCH, GREEN, SOIC-8
Reach Compliance Code：unknown风险等级：5.77
Is Samacsys：NJESD-30 代码：R-PDSO-G8
长度：4.9 mm端子数量：8
最高工作温度：85 °C最低工作温度：-40 °C
最大输出时钟频率：120 MHz封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE主时钟/晶体标称频率：14.31818 MHz
认证状态：Not Qualified座面最大高度：1.75 mm
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL宽度：3.91 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHERBase Number Matches：1

ASM3I2508AG-08SR 数据手册

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February 2007  
rev 1.4  
ASM3P2508A  
DC Electrical Characteristics  
(Test Condition : All the parameters are measured at room temperature (25°C) , unless otherwise stated)  
Parameter  
Symbol  
Conditions / Description  
Min  
Typ  
Max  
Unit  
Overall  
Supply Current,  
VDD =3.3V, FCLK =14.31818MHz,  
CL=15pF  
Icc  
40  
27  
49  
35  
60  
43  
mA  
mA  
Dynamic  
Supply Current,  
Static  
IDD  
VDD = 3.3V, Software Power Down*  
All input pins  
High-Level Input  
VIH  
VIL  
IIH  
VDD=3.3V  
VDD=3.3V  
2.0  
VSS-0.3  
-1  
-
-
VDD+0.3  
0.8  
V
Voltage  
Low-Level Input  
Voltage  
V
High-Level Input  
Current  
µ A  
-
1
Low-Level Input  
µ A  
IIL  
-20  
-36  
-80  
Current (pull-up)  
Clock Outputs (FOUT1CLK, FOUT2CLK)  
High-Level Output  
VOH  
VOL  
VDD= 3.3V, IOH = 20mA  
2.5  
0
-
-
3.3  
0.4  
V
V
Voltage  
Low-Level Output  
Voltage  
VDD= 3.3V, IOL = 20mA  
ZOH  
ZOL  
VO=0.5VDD; output driving high  
Vo=0.5VDD; output driving low  
-
-
29  
27  
-
-
Output Impedance  
Ω
* FOUT1CLK (120MHz) is functional and not loaded  
AC Electrical Characteristics  
Parameter  
Rise Time  
Fall Time  
Symbol  
Conditions/ Description  
Min  
Typ  
Max  
Unit  
pS  
FOUT1CLK  
640  
440  
660  
460  
680  
480  
720  
520  
750  
600  
800  
570  
tr  
tf  
VO = 0.8V to 2.0V; CL = 15pF  
VO = 2.0V to 0.8V; CL = 15pF  
FOUT2CLK  
FOUT1CLK  
FOUT2CLK  
pS  
Clock Duty  
Cycle  
Ratio of pulse width (as measured from rising edge  
tD  
45  
-
55  
%
to next falling edge at 2.5V) to one clock period  
Output Frequency =120MHz  
Output Frequency =72MHz /48 MHz  
-
-
±2.73  
±1.78  
-
-
Frequency  
Deviation  
fD  
%
On rising edges 500 uS apart at 2.5 V relative to an  
-
-
-
-
45  
-
-
-
-
ideal clock, PLL B inactive *  
Jitter, Long  
Term  
Tj (LT)  
pS  
On rising edges 500 uS apart at 2.5 V relative to an  
ideal clock, PLL B active *  
165  
110  
390  
From rising edge to next rising edge at 2.5 V,  
PLL B inactive *  
Jitter, peak to  
peak  
Tj (∆T)  
pS  
µS  
From rising edge to next rising edge at 2.5 V,  
PLL B active *  
Clock  
Output active from power up, RUN Mode via  
Software Power Down  
Stabilization  
Time  
tSTB  
-
125  
-
* CL = 15 pF, Fxin = 14.31818MHz  
Peak EMI Reducing Solution  
3 of 9  
Notice: The information in this document is subject to change without notice.  
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与ASM3I2508AG-08SR相关器件

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ASM3I2508AG-08ST PULSECORE Peak EMI Reducing Solution

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ASM3I2508SP-08SR ALSC Clock Synthesizer and Frequency Generator with Peak EMI reduction

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ASM3I2508SP-08SR PULSECORE Clock Generator, 33.33MHz, CMOS, PDSO8, 0.150 INCH, SOIC-8

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