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ADUM3211TRZ-RL7

更新时间： 2024-02-15 00:06:53
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
20页 526K
描述
Dual-Channel Digital Isolators, Enhanced System-Level ESD Reliability

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ADUM3211TRZ-RL7 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP,针数：8
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：1.54
接口集成电路类型：INTERFACE CIRCUITJESD-30 代码：R-PDSO-G8
JESD-609代码：e3长度：4.9 mm
湿度敏感等级：1功能数量：1
端子数量：8封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：1.75 mm
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：MATTE TIN
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：3.9 mmBase Number Matches：1

ADUM3211TRZ-RL7 数据手册

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ADuM3210/ADuM3211  
ELECTRICAL CHARACTERISTICS—5 V, 125°C OPERATION  
All typical specifications are at TA = 25°C, VDD1 = VDD2 = 5 V. Minimum/maximum specifications apply over the entire recommended  
operation range: 4.5 V ≤ VDD1 ≤ 5.5 V, 4.5 V ≤ VDD2 ≤ 5.5 V, and −40°C ≤ TA ≤ +125°C, unless otherwise noted. Switching specifications  
are tested with CL = 15 pF and CMOS signal levels, unless otherwise noted.  
Table 13.  
Parameter  
Min  
20  
Typ  
Max  
Unit  
Test Conditions/Comments  
SWITCHING SPECIFICATIONS  
Data Rate  
Propagation Delay  
Pulse Width Distortion  
Change vs. Temperature  
Pulse Width  
Propagation Delay Skew  
Channel Matching  
Codirectional  
Opposing-Direction  
Output Rise/Fall Time  
10  
50  
3
Mbps  
ns  
ns  
ps/°C  
ns  
ns  
Within PWD limit  
50% input to 50% output  
|tPLH − tPHL|  
tPHL, tPLH  
PWD  
5
PW  
tPSK  
100  
Within PWD limit  
Between any two units  
15  
tPSKCD  
tPSKOD  
tR/tF  
3
15  
ns  
ns  
ns  
2.5  
10% to 90%  
Table 14.  
1 Mbps  
Typ  
10 Mbps  
Typ  
Parameter  
Symbol  
Min  
Max  
Min  
Max  
Unit  
Test Conditions  
SUPPLY CURRENT  
ADuM3210  
IDD1  
IDD2  
IDD1  
IDD2  
1.3  
1.0  
1.1  
1.3  
1.7  
1.6  
1.5  
1.8  
3.5  
1.7  
2.6  
3.1  
4.6  
2.8  
3.4  
4.0  
mA  
mA  
mA  
mA  
ADuM3211  
Table 15. For All Models  
Parameter  
Symbol  
Min  
Typ  
Max  
Unit  
Test Conditions  
DC SPECIFICATIONS  
Logic High Input Threshold  
Logic Low Input Threshold  
Logic High Output Voltages  
VIH  
VIL  
VOH  
0.7 VDDX  
V
V
V
V
V
V
μA  
0.3 VDDX  
VDDX − 0.1  
VDDX − 0.5  
5.0  
4.8  
0.0  
0.2  
IOx = −20 μA, VIx = VIxH  
IOx = −4 mA, VIx = VIxH  
IOx = 20 μA, VIx = VIxL  
IOx = 4 mA, VIx = VIxL  
0 V ≤ VIx ≤ VDDX  
Logic Low Output Voltages  
VOL  
II  
0.1  
0.4  
+10  
Input Current per Channel  
Supply Current per Channel  
Quiescent Input Supply Current  
Quiescent Output Supply Current  
Dynamic Input Supply Current  
Dynamic Output Supply Current  
AC SPECIFICATIONS  
−10  
+0.01  
IDDI(Q)  
IDDO(Q)  
IDDI(D)  
IDDO(D)  
0.4  
0.5  
0.19  
0.05  
0.8  
0.6  
mA  
mA  
mA/Mbps  
mA/Mbps  
Common-Mode Transient Immunity1  
|CM|  
fr  
25  
35  
kV/μs  
Mbps  
VIx = VDDX, VCM = 1000 V,  
transient magnitude = 800 V  
Refresh Rate  
1.2  
1 |CM| is the maximum common-mode voltage slew rate that can be sustained while maintaining VO > 0.8 VDD. The common-mode voltage slew rates apply to both  
rising and falling common-mode voltage edges.  
Rev. C | Page 7 of 20  
 
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