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ADUM1200WURZ35-RL7 PDF预览

ADUM1200WURZ35-RL7

更新时间： 2024-02-27 02:54:18
品牌 Logo 应用领域
亚德诺 - ADI 光电二极管接口集成电路
页数 文件大小 规格书
28页 571K
描述
Interface Circuit

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ADUM1200WURZ35-RL7 技术参数

是否Rohs认证： 符合生命周期：Obsolete
包装说明：SOIC-8Reach Compliance Code：compliant
风险等级：5.56接口集成电路类型：INTERFACE CIRCUIT
JESD-30 代码：R-PDSO-G8长度：4.9 mm
功能数量：2端子数量：8
最高工作温度：125 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP8,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：NOT SPECIFIED
座面最大高度：1.75 mm最大供电电压：5.5 V
最小供电电压：3 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：3.9 mm
Base Number Matches：1

ADUM1200WURZ35-RL7 数据手册

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Data Sheet  
ADuM1200/ADuM1201  
Parameter  
Symbol  
Min  
Typ  
Max  
Unit  
Test Conditions /Comments  
25 Mbps (CR Grade Only)  
VDD1 Supply Current  
5 V/3 V Operation  
3 V/5 V Operation  
VDD2 Supply Current  
5 V/3 V Operation  
3 V/5 V Operation  
IDD1 (25)  
6.3  
3.4  
8.0  
4.8  
mA  
mA  
12.5 MHz logic signal freq.  
12.5 MHz logic signal freq.  
IDD2 (25)  
3.4  
6.3  
4.8  
8.0  
mA  
mA  
12.5 MHz logic signal freq.  
12.5 MHz logic signal freq.  
For All Models  
Input Currents  
IIA, IIB  
VIH  
VIL  
−10  
0.7 (VDD1 or VDD2)  
+0.01  
+10  
µA  
V
V
V
V
V
V
V
0 V ≤ VIA, VIB ≤ (VDD1 or VDD2)  
Logic High Input Threshold  
Logic Low Input Threshold  
Logic High Output Voltages  
0.3 (VDD1 or VDD2  
)
VOAH, VOBH  
(VDD1 or VDD2) − 0.1 VDD1 or VDD2  
(VDD1 or VDD2) − 0.5 (VDD1 or VDD2) − 0.2  
IOx = −20 µA, VIx = VIxH  
IOx = −4 mA, VIx = VIxH  
IOx = 20 µA, VIx = VIxL  
IOx = 400 µA, VIx = VIxL  
IOx = 4 mA, VIx = VIxL  
Logic Low Output Voltages  
VOAL, VOBL  
0.0  
0.04  
0.2  
0.1  
0.1  
0.4  
SWITCHING SPECIFICATIONS  
ADuM1200/ADuM1201AR  
Minimum Pulse Width2  
Maximum Data Rate3  
CL = 15 pF, CMOS signal levels  
PW  
1000  
ns  
Mbps  
ns  
1
50  
Propagation Delay4  
Pulse Width Distortion, |tPLH − tPHL  
tPHL, tPLH  
PWD  
150  
40  
4
|
ns  
Change vs. Temperature  
Propagation Delay Skew5  
Channel-to-Channel Matching6  
Output Rise/Fall Time (10% to 90%)  
ADuM1200/ADuM1201BR  
Minimum Pulse Width2  
11  
10  
ps/°C  
ns  
ns  
tPSK  
tPSKCD/tPSKOD  
tR/tF  
50  
50  
ns  
CL = 15 pF, CMOS signal levels  
PW  
100  
ns  
Maximum Data Rate3  
Propagation Delay4  
10  
15  
Mbps  
ns  
tPHL, tPLH  
PWD  
55  
3
4
Pulse Width Distortion, |tPLH − tPHL  
|
ns  
Change vs. Temperature  
Propagation Delay Skew5  
Channel-to-Channel Matching  
Codirectional Channels6  
Opposing Directional Channels6  
Output Rise/Fall Time (10% to 90%)  
5 V/3 V Operation  
5
ps/°C  
ns  
tPSK  
22  
tPSKCD  
tPSKOD  
tR/tF  
3
ns  
ns  
22  
3.0  
2.5  
ns  
ns  
3 V/5 V Operation  
ADuM1200/ADuM1201CR  
Minimum Pulse Width2  
CL = 15 pF, CMOS signal levels  
PW  
20  
40  
ns  
Maximum Data Rate3  
Propagation Delay4  
25  
20  
50  
5
Mbps  
ns  
tPHL, tPLH  
PWD  
50  
3
4
ns  
Pulse Width Distortion, |tPLH − tPHL  
|
Change vs. Temperature  
Propagation Delay Skew5  
Channel-to-Channel Matching  
Codirectional Channels6  
Opposing Directional Channels6  
Output Rise/Fall Time (10% to 90%)  
5 V/3 V Operation  
ps/°C  
ns  
tPSK  
15  
tPSKCD  
tPSKOD  
tR/tF  
3
ns  
ns  
15  
3.0  
2.5  
ns  
ns  
3 V/5 V Operation  
Rev. K | Page 9 of 28  
1...6789101112...28

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