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ADUC834

更新时间： 2024-02-03 02:33:17
品牌 Logo 应用领域
亚德诺 - ADI 转换器闪存
页数 文件大小 规格书
72页 1436K
描述
MicroConverter, Dual 16-/24- Bit ADCs with Embedded 62KB FLASH MCU

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ADUC834 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：QFP,针数：52
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.31.00.01风险等级：1.67
Samacsys Confidence：3Samacsys Status：Released
2D Presentation：https://componentsearchengine.com/2D/0T/2156.2.1.pngSchematic Symbol：https://componentsearchengine.com/symbol.php?partID=2156
PCB Footprint：https://componentsearchengine.com/footprint.php?partID=21563D View：https://componentsearchengine.com/viewer/3D.php?partID=2156
Samacsys PartID：2156Samacsys Image：https://componentsearchengine.com/Images/9/ADUC834BSZ.jpg
Samacsys Thumbnail Image：https://componentsearchengine.com/Thumbnails/2/ADUC834BSZ.jpgSamacsys Pin Count：52
Samacsys Part Category：Integrated CircuitSamacsys Package Category：Quad Flat Packages
Samacsys Footprint Name：S-52-2Samacsys Released Date：2015-04-16 09:48:08
Is Samacsys：N具有ADC：YES
其他特性：ALSO OPERATES AT 5V SUPPLY地址总线宽度：24
位大小：8最大时钟频率：12.58 MHz
DAC 通道：YESDMA 通道：NO
外部数据总线宽度：8JESD-30 代码：S-PQFP-G52
JESD-609代码：e3长度：10 mm
湿度敏感等级：3I/O 线路数量：32
端子数量：52最高工作温度：125 °C
最低工作温度：-40 °CPWM 通道：YES
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装形状：SQUARE封装形式：FLATPACK
峰值回流温度（摄氏度）：260认证状态：Not Qualified
ROM可编程性：FLASH座面最大高度：2.45 mm
速度：12.58 MHz最大供电电压：3.6 V
最小供电电压：2.7 V标称供电电压：3 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.65 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：10 mmuPs/uCs/外围集成电路类型：MICROCONTROLLER
Base Number Matches：1

ADUC834 数据手册

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PRELIMINARY TECHNICAL DATA  
ADuC834  
(AV = 2.7 V to 3.6 V or 4.75 V to 5.25 V, DV = 2.7 V to 3.6 V or 4.75 V to 5.25 V; all  
DD  
DD  
1, 2, 3  
TIMING SPECIFICATIONS  
specifications T to TMAX unless otherwise noted.)  
MIN  
32.768 kH z External Crystal  
P aram eter  
Min  
Typ  
Max  
Unit  
Figure  
CLOCK INPUT (External Clock Driven XT AL1)  
tCK  
tCKL  
XT AL1 Period  
XT AL1 Width Low  
XT AL1 Width High  
XT AL1 Rise T ime  
30.52  
15.16  
15.16  
20  
µs  
µs  
µs  
ns  
ns  
MHz  
µs  
1
1
1
1
1
tCKH  
tCKR  
tCKF  
1/tCORE  
tCORE  
tCYC  
XT AL1 Fall T ime  
20  
ADuC834 Core Clock Frequency4  
ADuC834 Core Clock Period5  
ADuC834 Machine Cycle T ime6  
0.098  
0.95  
12.58  
0.636  
7.6  
122.45  
µs  
N OT ES  
1AC inputs during testing are driven at DVDD – 0.5 V for a Logic 1, and 0.45 V for a Logic 0. T iming measurements are made at VIH min for a Logic 1, and VIL max  
for a Logic 0 as shown in Figure 2.  
2For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to float when a 100 mV change from the  
loaded VOH/VOL level occurs as shown in Figure 2.  
3CLOAD for Port0, ALE, PSEN outputs = 100 pF; CLOAD for all other outputs = 80 pF unless otherwise noted.  
4ADuC834 internal PLL locks onto a multiple (384 times) the external crystal frequency of 32.768 kHz to provide a Stable 12.583 MHz internal clock for the  
system. T he core can operate at this frequency or at a binary submultiple called Core_Clk, selected via the PLLCON SFR.  
5T his number is measured at the default Core_Clk operating frequency of 1.57 MHz.  
6ADuC834 Machine Cycle T ime is nominally defined as 12/Core_CLK.  
tCKR  
tCHK  
tCKL  
tCKF  
tCK  
Figure 1. XTAL1 Input  
DVDD › 0.5V  
VLOAD › 0.1V  
VLOAD › 0.1V  
0.2DVDD + 0.9V  
TEST POINTS  
TIMING  
REFERENCE  
POINTS  
VLOAD  
VLOAD  
0.2DVDD  
› 0.1V  
VLOAD + 0.1V  
VLOAD + 0.1V  
0.45V  
Figure 2. Tim ing Waveform Characteristics  
–8–  
(12 March 2002) REV. PrC  
1...567891011...72

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