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ADM1485AN

更新时间： 2024-02-11 21:19:37
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
8页 141K
描述
+-5 V Low Power EIA RS-485 Transceiver

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ADM1485AN 技术参数

是否无铅：含铅是否Rohs认证：符合
生命周期：Active零件包装代码：SOIC
包装说明：SOIC-8针数：8
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：0.7
Samacsys Confidence：3Samacsys Status：Released
2D Presentation：https://componentsearchengine.com/2D/0T/236838.1.2.pngSchematic Symbol：https://componentsearchengine.com/symbol.php?partID=236838
PCB Footprint：https://componentsearchengine.com/footprint.php?partID=2368383D View：https://componentsearchengine.com/viewer/3D.php?partID=236838
Samacsys PartID：236838Samacsys Image：https://componentsearchengine.com/Images/9/ADM1485JRZ-REEL.jpg
Samacsys Thumbnail Image：https://componentsearchengine.com/Thumbnails/1/ADM1485JRZ-REEL.jpgSamacsys Pin Count：8
Samacsys Part Category：Integrated CircuitSamacsys Package Category：Small Outline Packages
Samacsys Footprint Name：R-8 (SOIC)Samacsys Released Date：2015-11-06 07:15:09
Is Samacsys：N其他特性：THERMAL SHUTDOWN PROTECTION
差分输出：YES驱动器位数：1
高电平输入电流最大值：0.000001 A输入特性：DIFFERENTIAL SCHMITT TRIGGER
接口集成电路类型：LINE TRANSCEIVER接口标准：EIA-422; EIA-485
JESD-30 代码：R-PDSO-G8JESD-609代码：e3
长度：4.9 mm湿度敏感等级：1
功能数量：1端子数量：8
最高工作温度：70 °C最低工作温度：
最小输出摆幅：1.5 V输出特性：3-STATE
最大输出低电流：0.004 A输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP8,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
电源：5 V认证状态：Not Qualified
最大接收延迟：40 ns接收器位数：1
座面最大高度：1.75 mm子类别：Line Driver or Receivers
最大压摆率：2.2 mA最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：YES技术：BICMOS
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
最大传输延迟：15 ns宽度：3.9 mm
Base Number Matches：1

ADM1485AN 数据手册

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(V = +5 V ꢀ 5%. All specifications TMIN to TMAX unless otherwise noted.)  
ADM1485–SPECIFICATIONS  
CC  
Parameter  
Min Typ Max  
Unit  
Test Conditions/Comments  
DRIVER  
Differential Output Voltage, VOD  
5.0  
5.0  
5.0  
5.0  
0.2  
3
0.2  
250  
250  
0.8  
V
V
V
V
V
V
V
mA  
mA  
V
V
µA  
R = ∞, Figure 1  
2.0  
1.5  
1.5  
VCC = 5 V, R = 50 Ω (RS-422), Figure 1  
R = 27 Ω (RS-485), Figure 1  
VTST = –7 V to +12 V, Figure 2  
R = 27 Ω or 50 Ω, Figure 1  
R = 27 Ω or 50 Ω, Figure 1  
R = 27 Ω or 50 Ω  
–7 V ≤ VO ≤ +12 V  
–7 V ≤ VO ≤ +12 V  
VOD3  
∆|VOD| for Complementary Output States  
Common-Mode Output Voltage VOC  
∆|VOD| for Complementary Output States  
Output Short Circuit Current (VOUT = High)  
Output Short Circuit Current (VOUT = Low)  
CMOS Input Logic Threshold Low, VINL  
CMOS Input Logic Threshold High, VINH  
Logic Input Current (DE, DI)  
35  
35  
2.0  
1.0  
RECEIVER  
Differential Input Threshold Voltage, VTH  
Input Voltage Hysteresis, ∆VTH  
Input Resistance  
–0.2  
12  
+0.2  
V
–7 V ≤ VCM ≤ +12 V  
VCM = 0 V  
–7 V ≤ VCM ≤ +12 V  
VIN = 12 V  
70  
mV  
kΩ  
mA  
mA  
µA  
V
V
mA  
µA  
Input Current (A, B)  
+ 1  
–0.8  
1
VIN = –7 V  
Logic Enable Input Current (RE)  
CMOS Output Voltage Low, VOL  
CMOS Output Voltage High, VOH  
Short Circuit Output Current  
0.4  
IOUT = +4.0 mA  
IOUT = –4.0 mA  
VOUT = GND or VCC  
4.0  
7
85  
1.0  
Tristate Output Leakage Current  
0.4 V ≤ VOUT ≤ +2.4 V  
POWER SUPPLY CURRENT  
ICC (Outputs Enabled)  
ICC (Outputs Disabled)  
1.35 2.2  
0.7  
mA  
mA  
Outputs Unloaded, Digital Inputs = GND or VCC  
Outputs Unloaded, Digital Inputs = GND or VCC  
1
Specifications subject to change without notice.  
(V = +5 V ꢀ 5%. All specifications TMIN to TMAX unless otherwise noted.)  
TIMING SPECIFICATIONS  
CC  
Parameter  
Min Typ  
Max  
Unit Test Conditions/Comments  
DRIVER  
Propagation Delay Input to Output TPLH, TPHL  
Driver O/P to O/P TSKEW  
Driver Rise/Fall Time TR, TF  
Driver Enable to Output Valid  
Driver Disable Timing  
2
10  
0
2
10  
10  
15  
5
10  
25  
25  
ns  
ns  
ns  
ns  
ns  
RL Diff = 54 Ω CL1 = CL2 = 100 pF, Figure 3  
RL Diff = 54 Ω CL1 = CL2 = 100 pF, Figure 3  
RL Diff = 54 Ω CL1 = CL2 = 100 pF, Figure 3  
RECEIVER  
Propagation Delay Input to Output TPLH, TPHL  
Skew |TPLH–TPHL  
Receiver Enable TEN1  
18  
25  
0
15  
40  
5
25  
ns  
ns  
ns  
ns  
CL = 15 pF, Figure 5  
|
Figure 6  
Figure 6  
Receiver Disable TEN2  
15  
25  
Specifications subject to change without notice.  
–2–  
REV. A  
12345678

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