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ADM1032AR

更新时间： 2024-01-10 18:05:39
品牌 Logo 应用领域
亚德诺 - ADI 监控
页数 文件大小 规格书
12页 166K
描述
+-1C Remote and Local System Temperature Monitor

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ADM1032AR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：SOIC
包装说明：SOP,针数：8
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5
Is Samacsys：N其他特性：PROGRAMMABLE OVER/UNDER TEMPERATURE LIMIT
模拟集成电路 - 其他类型：ANALOG CIRCUITJESD-30 代码：R-PDSO-G8
JESD-609代码：e3长度：4.9 mm
湿度敏感等级：1功能数量：1
端子数量：8最高工作温度：120 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：1.75 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
温度等级：OTHER端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：3.9 mmBase Number Matches：1

ADM1032AR 数据手册

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ADM1032–SPECIFICATIONS (TA = TMIN to TMAX, VDD = VMIN to VMAX, unless otherwise noted.)  
Parameter  
Min  
Typ  
Max  
Unit  
Test Conditions/Comments  
POWER SUPPLY  
Supply Voltage, VDD  
Average Operating Supply Current, ICC  
3.0  
3.30  
170  
5.5  
5.5  
215  
10  
2.8  
2.4  
V
µA  
µA  
V
0.0625 Conversions/Sec Rate1  
Standby Mode  
VDD Input, Disables ADC, Rising Edge  
Undervoltage Lockout Threshold  
Power-On Reset Threshold  
2.35  
1
2.55  
V
TEMPERATURE-TO-DIGITAL CONVERTER  
Local Sensor Accuracy  
Resolution  
1
1
3
°C  
°C  
°C  
°C  
°C  
µA  
µA  
ms  
0 ≤ TA ≤ 100°C, VCC = 3 V to 3.6 V  
Remote Diode Sensor Accuracy  
1
3
60°C ≤ TD ≤ 100°C, VCC = 3 V to 3.6 V  
0°C ≤ TD ≤ 120°C  
Resolution  
Remote Sensor Source Current  
0.125  
230  
13  
High Level, Note 2  
Low Level, Note 2  
Conversion Time  
35.7  
5.7  
142.8  
22.8  
From Stop Bit to Conversion Complete  
(Both Channels) One-Shot Mode with  
Averaging Switched On  
One-Shot Mode with Averaging Off  
(i.e., Conversion Rate = 32 or 64  
Conversions per Second)  
ms  
OPEN-DRAIN DIGITAL OUTPUTS  
(THERM, ALERT)  
Output Low Voltage, VOL  
0.4  
1
V
µA  
IOUT = –6.0 mA2  
VOUT = VDD  
2
High Level Output Leakage Current, IOH  
0.1  
SMBus INTERFACE2  
Logic Input High Voltage, VIH  
SCLK, SDATA  
2.1  
V
VDD = 3 V to 5.5 V  
VDD = 3 V to 5.5 V  
Logic Input Low Voltage, VIL  
0.8  
V
Hysteresis  
500  
mV  
SCLK, SDATA  
SMBus Output Low Sink Current  
ALERT Output Low Sink Current  
Logic Input Current, IIH, IIL  
SMBus Input Capacitance, SCLK, SDATA  
SMBus Clock Frequency  
6
1
–1  
mA  
mA  
µA  
pF  
kHz  
ms  
µs  
SDATA Forced to 0.6 V  
ALERT Forced to 0.4 V  
+1  
5
100  
64  
SMBus Timeout  
25  
Note 3  
tLOW between 10% Points  
tHIGH between 90% Points  
SMBus Clock Low Time, tLOW  
SMBus Clock High Time, tHIGH  
SMBus Start Condition Setup Time, tSU:STA  
SMBus Start Condition Hold Time, tHD:STA  
4.7  
4
4.7  
4
µs  
µs  
µs  
Time from 10% of SDATA to 90%  
of SCLK  
SMBus Stop Condition Setup Time, tSU:STO  
4
µs  
Time from 90% of SCLK to 10%  
of SDATA  
SMBus Data Valid to SCLK Rising Edge  
Time, tSU:DAT  
250  
ns  
Time for 10% or 90% of SDATA to  
10% of SCLK  
SMBus Data Hold Time, tHD:DAT  
SMBus Bus Free Time, tBUF  
SCLK Falling Edge to SDATA  
Valid Time, tVD,DAT  
SCLK, SDATA Rise Time, tR  
SCLK, SDATA Fall Time, tF  
300  
4.7  
µs  
µs  
µs  
Between Start/Stop Condition  
Master Clocking in Data  
1
1
300  
µs  
ns  
NOTES  
1See Table VI for information on other conversion rates.  
2Guaranteed by Design, not production tested.  
3The SMBus timeout is a programmable feature. By default it is not enabled. Details on how to enable it are available in the SMBus section of this data sheet.  
Specifications subject to change without notice.  
–2–  
REV. 0  
1234567...12

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型号 品牌 描述 获取价格 数据表
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