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Datasheet > 驱动程序和接口 > 其他接口集成电路> AD9984AKSTZ-170
AD9984AKSTZ-170 PDF预览

AD9984AKSTZ-170

更新时间： 2024-01-23 08:10:37
品牌 Logo 应用领域
亚德诺 - ADI 显示器驱动程序和接口接口集成电路
页数 文件大小 规格书
44页 616K
描述
High Performance 10-Bit Display Interface

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AD9984AKSTZ-170 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：LQFP,针数：80
Reach Compliance Code：unknown风险等级：5.09
Is Samacsys：N接口集成电路类型：INTERFACE CIRCUIT
JESD-30 代码：S-PQFP-G80JESD-609代码：e3
长度：14 mm湿度敏感等级：3
功能数量：1端子数量：80
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：LQFP
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：260认证状态：COMMERCIAL
座面最大高度：1.6 mm最大供电电压：1.9 V
最小供电电压：1.7 V标称供电电压：1.8 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.65 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：14 mmBase Number Matches：1

AD9984AKSTZ-170 数据手册

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AD9984A  
SPECIFICATIONS  
ANALOG INTERFACE CHARACTERISTICS  
VD = 1.8 V, VDD = 3.3 V, PVD = 1.8 V, DAVDD = 1.8 V, ADC clock = maximum conversion rate, full temperature range = 0°C to 70°C.  
Table 1. Electrical Characteristics  
AD9984AKSTZ-140  
AD9984AKCPZ-140  
AD9984AKSTZ-170  
AD9984AKCPZ-170  
Test  
Level1  
Parameter  
Temp  
Min  
Typ  
Max  
Min  
Typ  
Max  
Unit  
RESOLUTION  
Number of Bits  
LSB Size  
10  
0.098  
10  
0.098  
Bits  
% of full scale (FS)  
DC ACCURACY  
Differential Nonlinearity  
25°C  
Full  
25°C  
Full  
I
VI  
I
VI  
VI  
0.6  
2.35  
GNT2  
+1.8/−1.0  
+1.9/−1.0  
7.0  
0.7  
2.35  
GNT2  
+1.9/−1.0 LSB  
+2.0/−1.0 LSB  
Integral Nonlinearity  
8.5  
9.0  
LSB  
LSB  
9.0  
No Missing Codes  
ANALOG INPUT  
Input Voltage Range  
Minimum  
Maximum  
Gain Tempco  
Full  
Full  
Full  
25°C  
25°C  
Full  
Full  
Full  
VI  
VI  
V
IV  
IV  
VI  
VI  
0.5  
0.5  
V p-p  
V p-p  
ppm/°C  
μA  
1.0  
1.0  
125  
125  
Input Bias Current  
1
1
1
1
μA  
Input Full-Scale Matching  
Offset Adjustment Range  
SWITCHING PERFORMANCE  
Maximum Conversion Rate  
Minimum Conversion Rate  
1
50  
1
50  
% FS  
% FS  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
VI  
IV  
IV  
VI  
VI  
VI  
VI  
VI  
VI  
VI  
VI  
VI  
IV  
IV  
140  
170  
MSPS  
MSPS  
ns  
10  
+2.0  
10  
+2.0  
Clock to Data Skew (tSKEW  
)
−0.5  
4.7  
4.0  
0
4.7  
4.0  
250  
4.7  
4.0  
140  
−0.5  
4.7  
4.0  
0
4.7  
4.0  
250  
4.7  
4.0  
170  
tBUFF  
tSTAH  
tDHO  
tDAL  
tDAH  
tDSU  
tSTASU  
tSTOSU  
μs  
μs  
μs  
μs  
μs  
ns  
μs  
μs  
Maximum PLL Clock Rate  
Minimum PLL Clock Rate  
Sampling Phase Tempco  
DIGITAL INPUTS  
Input Voltage, High (VIH)  
Input Voltage, Low (VIL)  
Input Current, High (IIH)  
Input Current, Low (IIL)  
Input Capacitance  
DIGITAL OUTPUTS  
Output Voltage, High (VOH)  
Output Voltage, Low (VOL)  
Duty Cycle (DATACK)  
Output Coding  
MHz  
MHz  
ps/°C  
10  
10  
15  
15  
Full  
Full  
Full  
Full  
25°C  
VI  
VI  
V
V
V
1.0  
1.0  
V
0.8  
−1.0  
1.0  
0.8  
V
−1.0  
1.0  
μA  
μA  
pF  
2
2
Full  
Full  
Full  
VI  
VI  
IV  
VDD − 0.1  
45  
VDD − 0.1  
45  
V
0.1  
55  
0.1  
55  
V
%
50  
Binary  
50  
Binary  
Rev. 0 | Page 3 of 44  
 
 
1234567...44

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