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AD9851BRSZ

更新时间： 2024-01-15 14:24:18
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亚德诺 - ADI 模拟IC信号电路光电二极管数据分配系统
页数 文件大小 规格书
24页 749K
描述
CMOS 180 MHz DDS/DAC Synthesizer

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AD9851BRSZ 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SSOP
包装说明：SSOP,针数：28
Reach Compliance Code：unknown风险等级：5.05
Is Samacsys：N模拟集成电路 - 其他类型：ANALOG CIRCUIT
JESD-30 代码：R-PDSO-G28JESD-609代码：e3
长度：10.2 mm湿度敏感等级：1
功能数量：1端子数量：28
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：260座面最大高度：2 mm
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：MATTE TIN端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：5.3 mm
Base Number Matches：1

AD9851BRSZ 数据手册

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1
(VS
= 5 V
5%, RSET
= 3.9 k
, 6
REFCLK Multiplier Disabled, External Reference  
Clock = 180 MHz, except as noted.)  
AD9851–SPECIFICATIONS  
T
e
st  
Level  
AD9851BRS  
Typ  
P
arameter  
Temp  
Min  
Max  
Unit  
CLOCK INPUT CHARACTERISTICS  
Frequency Range (6  
REFCLK Multiplier Disabled)  
5.0 V Supply  
3.3 V Supply  
2.7 V Supply  
Full  
Full  
0°C to 85°C  
IV  
IV  
IV  
1
1
1
180  
125  
100  
MHz  
MHz  
MHz  
Frequency Range (6  
5.0 V Supply  
3.3 V Supply  
2.7 V Supply  
Duty Cycle  
REFCLK Multiplier Enabled)  
Full  
Full  
0°C to 85°C  
Full  
Full  
IV  
IV  
IV  
IV  
IV  
V
5
5
5
45  
30  
MHz  
MHz  
MHz  
%
%
M  
20.83  
16.66  
60  
Duty Cycle (6  
REFCLK Multiplier Enabled)  
35  
65  
Input Resistance  
25°C  
1
Minimum SwitchingThresholds2  
Logic 1, 5.0 V Supply  
25°C  
25°C  
25°C  
25°C  
IV  
IV  
IV  
IV  
3.5  
2.3  
V
V
V
V
Logic 1, 3.3 V Supply  
Logic 0, 5.0 V Supply  
Logic 0, 3.3 V Supply  
1.5  
1
DAC OUTPUT CHARACTERISTICS  
Full-Scale Output Current  
Gain Error  
Output Offset  
Differential Nonlinearity  
25°C  
25°C  
25°C  
25°C  
25°C  
IV  
I
I
I
I
5
–10  
10  
20  
+10  
10  
0.75  
1
mA  
% FS  
µA  
LSB  
LSB  
Integral Nonlinearity  
Residual Phase Noise, 5.2 MHz, 1 kHz Offset  
PLL On  
PLL Off  
25°C  
25°C  
25°C  
25°C  
V
V
V
I
–125  
–132  
120  
dBc/Hz  
dBc/Hz  
k
  
Output Impedance  
Voltage Compliance Range  
Wideband Spurious-Free Dynamic Range  
1.1 MHz Analog Out (DC to 72 MHz)  
20.1 MHz Analog Out (DC to 72 MHz)  
40.1 MHz Analog Out (DC to 72 MHz)  
50.1 MHz Analog Out (DC to 72 MHz)  
70.1 MHz Analog Out (DC to 72 MHz)  
Narrowband Spurious-Free Dynamic Range  
1.1 MHz (±50 kHz)  
–0.5  
+1.5  
V
25°C  
25°C  
25°C  
25°C  
25°C  
IV  
IV  
IV  
IV  
IV  
60  
51  
51  
46  
42  
64  
53  
55  
53  
43  
dBc  
dBc  
dBc  
dBc  
dBc  
25°C  
25°C  
25°C  
25°C  
25°C  
25°C  
V
V
V
V
V
V
85  
80  
85  
80  
85  
73  
dBc  
dBc  
dBc  
dBc  
dBc  
dBc  
1.1 MHz (±200 kHz)  
40.1 MHz (±50 kHz)  
40.1 MHz (±200 kHz)  
70.1 MHz (±50 kHz)  
70.1 MHz (±200 kHz)  
COMPARATOR INPUT CHARACTERISTICS  
Input Capacitance  
Input Resistance  
Input Bias Current  
InputVoltage Range  
25°C  
25°C  
25°C  
25°C  
V
IV  
I
3
500  
12  
pF  
k  
µA  
V
IV  
0
5
COMPARATOR OUTPUT CHARACTERISTICS  
Logic 1Voltage 5V Supply  
Logic 1Voltage 3.3V Supply  
Logic 1Voltage 2.7V Supply  
Logic 0Voltage  
Continuous Output Current  
Hysteresis  
Propagation Delay  
25°C  
25°C  
25°C  
25°C  
25°C  
25°C  
25°C  
25°C  
25°C  
25°C  
VI  
VI  
VI  
VI  
IV  
IV  
IV  
IV  
IV  
IV  
4.8  
3.1  
2.3  
V
V
V
V
mA  
mV  
ns  
MHz  
ns  
+0.4  
20  
10  
7
200  
7
Toggle Frequency (1V p-p Input SineWave)  
Rise/FallTime, 15 pF Output Load  
Output Jitter (p-p)3  
80  
ps (p-p)  
CLOCK OUTPUT CHARACTERISTICS  
Output Jitter (Clock Generator Configuration,  
40 MHz 1V p-p Input SineWave)  
25°C  
Full  
V
IV  
250  
50 ± 10  
ps (p-p)  
%
Clock Output Duty Cycle  
–2–  
REV. D  
1234567...24

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