AD9851

更新时间： 2024-02-19 14:33:46

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亚德诺 - ADI		数据分配系统
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23页	257K
描述
CMOS 180 MHz DDS/DAC Synthesizer

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AD9851 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SSOP
包装说明：	SSOP,	针数：	28
Reach Compliance Code：	unknown	风险等级：	5.05
Is Samacsys：	N	模拟集成电路 - 其他类型：	ANALOG CIRCUIT
JESD-30 代码：	R-PDSO-G28	JESD-609代码：	e3
长度：	10.2 mm	湿度敏感等级：	1
功能数量：	1	端子数量：	28
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	座面最大高度：	2 mm
最大供电电压 (Vsup)：	5.25 V	最小供电电压 (Vsup)：	4.75 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	5.3 mm
Base Number Matches：	1

AD9851 数据手册

AD9851

W CLK #1

Differential DAC output connection (Figure 9) for reduction of

common-mode signals and to allow highly reactive filters to be

driven without a filter input termination resistor (see above

single-ended example, Figure 8). A 6 dB power advantage is

obtained at the filter output as compared with the single-ended

example, since the filter need not be doubly terminated.

W CLK IOUT

AD9851

FQ UD

RESET

W CLK #1

FQ UD

PHASE

MICROPROCESSOR

DIFFERENCE

8-BIT DATA BUS

RESET

REF

CLOCK

MICROCONTROLLER

RESET

DIFFERENTIAL

TRANSFORMER-COUPLED

RESET

FQ UD

IOUT

W CLK #2

OUTPUT

FILTER

REFERENCE

CLOCK

AD9851

50⍀

W CLK

AD9851

W CLK #2

DDS

Figure 7. Application Showing Synchronization of Two

AD9851 DDSs to Form a Quadrature Oscillator

50⍀

1:1 TRANSFORMER

i.e., MINI-CIRCUITS T1–1T

After a common RESET command is issued, separate W_CLKs

allow independent programming of each AD9851 40-bit input

FQ_UD pulse is issued after programming is completed to

simultaneously engage both oscillators at their specified fre-

quency and phase.

Figure 9. Differential DAC Output Connection for Reduc-

tion of Common-Mode Signals

The AD9851 R_SETinput being driven by an external DAC

(Figure 10) to provide amplitude modulation or fixed, digital

amplitude control of the DAC output current. Full description

of this application is found as a “Technical Note” on the AD9851

web page (site address is www.analog.com) under “Related

Information.” An Analog Devices application note for the

AD9850, AN-423, describes another method of amplitude

control using an enhancement-mode MOSFET that is equally

applicable to the AD9851.

BANDPASS

AMPLIFIER

FILTER

240MHz

IOUT

AD9851

50⍀

30MHz

CLOCK

AD9851

SPECTRUM

FINAL OUTPUT

SPECTRUM

NOTE: If the 6× REFCLK Multiplier of the AD9851 is en-

gaged, the 125 MHz clocking source shown in Figure 10 can be

reduced by a factor of six.

FUNDAMENTAL

+ F

– F

+ F

IMAGE

BANDPASS

FILTER

CLK

60 120

180 240

240

FREQUENCY – MHz

Figure 8. Deriving a High Frequency Output Signal from

the AD9851 by Using an “Alias” or Image Signal

+5V

330⍀

+5V

DIFFERENTIAL

TRANSFORMER-COUPLED

OUTPUT

20mA

MAX

DATA

4k⍀

10-BIT DAC

AD9731

GENERATOR

e.g., DG-2020

IOUT

10 BITS

SET

50⍀

200⍀

AD9851

DDS

–5V

IOUT

125MHz

50⍀

1:1 TRANSFORMER

CONTROL

DATA

COMPUTER

Figure 10. The AD9851 R_SETInput Being Driven by an External DAC

REV. C

–7–

1...4 5 678 9 10...23

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