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Datasheet > 微控制器和处理器 > 时钟发生器> AD9572-EVALZ-LVD
AD9572-EVALZ-LVD PDF预览

AD9572-EVALZ-LVD

更新时间： 2024-01-15 13:33:59
品牌 Logo 应用领域
亚德诺 - ADI 时钟发生器光纤以太网
页数 文件大小 规格书
20页 410K
描述
Fiber Channel/Ethernet Clock Generator IC, PLL Core, Dividers, 7 Clock Outputs

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AD9572-EVALZ-LVD 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFN
包装说明：HVQCCN, LCC40,.24SQ,20针数：40
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.25
Samacsys Description：Fiber Channel/Ethernet Clock Generator IC 7 Clock OutputsJESD-30 代码：S-XQCC-N40
JESD-609代码：e3长度：6 mm
湿度敏感等级：1端子数量：40
最高工作温度：85 °C最低工作温度：-40 °C
最大输出时钟频率：156.25 MHz封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装等效代码：LCC40,.24SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：3.3 V
主时钟/晶体标称频率：25 MHz认证状态：Not Qualified
座面最大高度：0.8 mm子类别：Clock Generators
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：6 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHER

AD9572-EVALZ-LVD 数据手册

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AD9572  
SPECIFICATIONS  
PLL CHARACTERISTICS  
Typical (typ) is given for VS = 3.3 V, TA = 25°C, unless otherwise noted.  
Table 1.  
Parameter  
Min  
Typ  
Max  
Unit  
Test Conditions/Comments  
PHASE NOISE CHARACTERISTICS  
PLL Noise (106.25 MHz LVDS Output)  
@ 1 kHz  
@ 10 kHz  
@ 100 kHz  
@ 1 MHz  
@ 10 MHz  
@ 30 MHz  
−123  
−127  
−129  
−150  
−152  
−153  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
PLL Noise (156.25 MHz LVDS Output)  
@ 1 kHz  
@ 10 kHz  
@ 100 kHz  
@ 1 MHz  
@ 10 MHz  
@ 30 MHz  
−118  
−125  
−126  
−145  
−151  
−151  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
PLL Noise (125 MHz LVDS Output)  
@ 1 kHz  
@ 10 kHz  
@ 100 kHz  
@ 1 MHz  
@ 10 MHz  
@ 30 MHz  
−119  
−127  
−128  
−147  
−151  
−152  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
PLL Noise (100 MHz LVDS Output)  
@ 1 kHz  
@ 10 kHz  
@ 100 kHz  
@ 1 MHz  
@ 10 MHz  
@ 30 MHz  
−121  
−128  
−130  
−147  
−150  
−150  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
PLL Noise (106.25 MHz LVPECL Output)  
@ 1 kHz  
@ 10 kHz  
@ 100 kHz  
@ 1 MHz  
@ 10 MHz  
@ 30 MHz  
−121  
−128  
−129  
−151  
−154  
−155  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
PLL Noise (156.25 MHz LVPECL Output)  
@ 1 kHz  
@ 10 kHz  
@ 100 kHz  
@ 1 MHz  
−119  
−125  
−126  
−147  
−152  
−153  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
dBc/Hz  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
33.33 MHz output disabled  
@ 10 MHz  
@ 30 MHz  
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