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AD8321-EVAL

更新时间： 2024-02-08 12:06:44

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亚德诺 - ADI		驱动器电视有线电视
页数	文件大小	规格书
19页	663K
描述
Gain Programmable CATV Line Driver

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AD8321-EVAL 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	LEAD FREE, MS-013AC, SOIC-20	针数：	20
Reach Compliance Code：	unknown	风险等级：	5.54
差分输出：	NO	驱动器位数：	1
输入特性：	DIFFERENTIAL	接口集成电路类型：	LINE DRIVER
接口标准：	GENERAL PURPOSE	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e3	长度：	12.8 mm
湿度敏感等级：	1	功能数量：	1
端子数量：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
座面最大高度：	2.65 mm	标称供电电压：	9 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	7.5 mm

AD8321-EVAL 数据手册

AD8321

LOGIC INPUTS (TTL/CMOS Logic) ^{(DATEN, CLK, SDATA, V}_CC= +9 V; Full Temperature Range)

Parameter

Min

Typ

Max

Units

Logic “1” Voltage

Logic “0” Voltage

2.1

5.0

0.8

Logic “1” Current (V_INH= 5 V) CLK, SDATA, DATEN

Logic “0” Current (V_INL= 0 V) CLK, SDATA, DATEN

Logic “1” Current (V_INH= 5 V) PD

Logic “0” Current (V_INL= 0 V) PD

–600

µA

–100

190

–30

–250

(Full Temperature Range, V = +9 V, T = T = 4 ns, f_CLK= 8 MHz unless otherwise noted.)

TIMING REQUIREMENTS

Parameter

Min

Typ

Max

Units

Clock Pulsewidth (T_WH

Clock Period (T_C)

Setup Time SDATA vs. Clock (T_DS

Setup Time DATEN vs. Clock (T_ES

Hold Time SDATA vs. Clock (T_DH

)

16.0

32.0

5.0

15.0

5.0

)

Hold Time DATEN vs. Clock (T_EH

Input Rise and Fall Times, SDATA, DATEN, Clock (T_R, T_F)

3.0

VALID DATA WORD G1

VALID DATA WORD G2

SDATA

CLK

MSB. . . .LSB

8 CLOCK CYCLES

DATEN

GAIN TRANSFER (G1)

GAIN TRANSFER (G2)

OFF

ANALOG

OUTPUT

PEDESTAL

SIGNAL AMPLITUDE (p-p)

Figure 2. Serial Interface Timing

VALID DATA BIT

MSB-1

SDATA MSB

MSB-2

CLK

Figure 3. SDATA Timing

–3–

REV. 0

1 234 5 6 7...19

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