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AD73311LARU-REEL

更新时间： 2024-02-22 10:02:35

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亚德诺 - ADI		/
页数	文件大小	规格书
36页	333K
描述
IC SPECIALTY TELECOM CIRCUIT, PDSO20, TSSOP-20, Telecom IC:Other

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AD73311LARU-REEL 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	SOP, SOP20,.4	针数：	20
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.07
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e3
长度：	12.8 mm	湿度敏感等级：	1
功能数量：	1	端子数量：	20
最高工作温度：	105 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP20,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
电源：	3 V	认证状态：	Not Qualified
座面最大高度：	2.65 mm	子类别：	Modems
最大压摆率：	0.0125 mA	标称供电电压：	3 V
表面贴装：	YES	技术：	CMOS
电信集成电路类型：	TELECOM CIRCUIT	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	7.5 mm
Base Number Matches：	1

AD73311LARU-REEL 数据手册

AD73311

(AVDD = +5 V ؎ 10%; DVDD = +5 V ؎ 10%; AGND = DGND = 0 V; T_A= T_MlNto T_MAX, unless

TIMING CHARACTERISTICS ^{otherwise noted)}

Limit at

T_A= –40؇C to +85؇C

Parameter

Unit

Description

Clock Signals

See Figure 1

MCLK Period

MCLK Width High

MCLK Width Low

t₁

t₂

t₃

24.4

ns min

Serial Port

t₄

t₅

t₆

t₇

t₈

t₉

t₁₀

t₁₁

t₁₂

t₁₃

See Figures 3 and 4

SCLK Period

SCLK Width High

SCLK Width Low

SDI/SDIFS Setup Before SCLK Low

SDI/SDIFS Hold After SCLK Low

SDOFS Delay from SCLK High

SDOFS Hold After SCLK High

SDO Hold After SCLK High

SDO Delay from SCLK High

SCLK Delay from MCLK

t₁

ns min

ns typ

0.4 × t₁

t₁

100␮A

t₂

TO OUTPUT

+2.1V

15pF

t₃

100␮A

Figure 1. MCLK Timing

Figure 2. Load Circuit for Timing Specifications

t₁

t₂

t₃

MCLK

t₁₃

t₅

t₆

SCLK

t₄

SCLK IS INDIVIDUALLY PROGRAMMABLE

IN FREQUENCY (MCLK/4 SHOWN HERE).

Figure 3. SCLK Timing

REV. B

–7–

1...4 5 678 9 10...36

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型号	品牌	描述	获取价格	数据表
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