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AD7264BCPZ-5 PDF预览

AD7264BCPZ-5

更新时间： 2024-01-01 08:52:05
品牌 Logo 应用领域
罗彻斯特 - ROCHESTER 转换器
页数 文件大小 规格书
29页 2659K
描述
DUAL 2-CH 14-BIT SUCCESSIVE APPROXIMATION ADC, SERIAL ACCESS, QCC48, MO-220VKKD-2, LFCSP-48

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AD7264BCPZ-5 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFN
包装说明：HVQCCN,针数：48
Reach Compliance Code：unknown风险等级：5.7
Is Samacsys：N最大模拟输入电压：3.755 V
最小模拟输入电压：1.255 V最长转换时间：0.53 µs
转换器类型：ADC, SUCCESSIVE APPROXIMATIONJESD-30 代码：S-XQCC-N48
JESD-609代码：e3长度：7 mm
最大线性误差 (EL)：0.0183%湿度敏感等级：3
模拟输入通道数量：2位数：14
功能数量：2端子数量：48
最高工作温度：105 °C最低工作温度：-40 °C
输出位码：2'S COMPLEMENT BINARY输出格式：SERIAL
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260采样速率：0.5 MHz
采样并保持/跟踪并保持：TRACK座面最大高度：1 mm
标称供电电压：5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7 mmBase Number Matches：1

AD7264BCPZ-5 数据手册

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Data Sheet  
AD7264  
SPECIFICATIONS  
AVCC = 4.75 V to 5.25 V, CA_CBVCC = CC_CDVCC = 2.7 V to 5.25 V, VDRIVE = 2.7 V to 5.25 V, fS = 1 MSPS and fSCLK = 34 MHz for the  
AD7264, fS = 500 kSPS and fSCLK = 20 MHz for the AD7264-5, VREF = 2.5 V internal/external; TA = −40°C to +105°C, unless otherwise noted.  
Table 1.  
Parameter  
Min  
Typ  
Max  
Unit  
Test Conditions/Comments  
fIN = 100 kHz sine wave  
PGA gain setting = 2  
DYNAMIC PERFORMANCE1  
Signal-to-Noise Ratio (SNR)2  
76  
74  
78  
77  
dB  
dB  
Signal-to-(Noise + Distortion) Ratio  
(SINAD)2  
Total Harmonic Distortion (THD)2  
−85  
−97  
−76  
−77  
dB  
dB  
dB  
Spurious-Free Dynamic Range (SFDR)  
Common-Mode Rejection Ratio (CMRR)  
For PGA gain setting = 2, ripple  
frequency of 50 Hz/60 Hz; see  
Figure 17 and Figure 18  
ADC-to-ADC Isolation2  
Bandwidth3  
−90  
1.2  
1.7  
dB  
MHz  
MHz  
@ −3 dB; PGA gain setting = 128  
@ −3 dB; PGA gain setting = 2  
DC ACCURACY  
Resolution  
14  
3
0.99  
0.305  
0.244  
0.305  
Bits  
LSB  
LSB  
Integral Nonlinearity2  
Differential Nonlinearity2  
Positive Full-Scale Error2  
1.5  
0.5  
0.122  
Guaranteed no missed codes to 14 bits  
Precalibration  
Postcalibration  
% FSR  
% FSR  
% FSR  
% FSR  
% FSR  
% FSR  
% FSR  
% FSR  
% FSR  
µV/°C  
0.018  
0.061  
0.092  
0.012  
0.061  
0.122  
0.018  
0.061  
Positive Full-Scale Error Match2  
Zero Code Error2  
Precalibration  
Postcalibration  
Zero Code Error Match2  
Negative Full-Scale Error2  
Precalibration  
Postcalibration  
Negative Full-Scale Error Match2  
Zero Code Error Drift  
2.5  
ANALOG INPUT  
Input Voltage Range, VIN+ and VIN−  
V
V
VCM = AVCC/2; PGA gain setting ≥ 2  
VREF  
VCM  
±
2 × Gain  
Common-Mode Voltage Range, VCM  
VCM − 100 mV  
VCM + 100 mV  
VCM = 2 V; PGA gain setting = 1;  
see Figure 194  
(VCC/2) − 0.4  
(VCC/2) − 0.4  
(VCC/2) − 0.6  
(VCC/2) + 0.2  
(VCC/2) + 0.4  
(VCC/2) + 0.8  
1
V
V
V
µA  
pF  
GΩ  
VCM = AVCC/2; PGA gain setting = 2  
VCM = AVCC/2; 3 ≤ PGA gain setting ≤ 32  
VCM = AVCC/2; PGA gain setting ≥ 48  
DC Leakage Current  
Input Capacitance3  
Input Impedance3  
0.001  
5
1
REFERENCE INPUT/OUTPUT  
Reference Output Voltage5  
Reference Input Voltage  
DC Leakage Current  
2.495  
2.5  
2.5  
0.3  
2.505  
1
V
V
µA  
2.5 V 5 mV max @ 25°C  
External reference applied to  
Pin VREFA/Pin VREF  
B
Input Capacitance3  
20  
4
20  
20  
pF  
Ω
ppm/°C  
µV rms  
VREFA, VREFB Output Impedance3  
Reference Temperature Coefficient  
VREF Noise3  
Rev. B | Page 3 of 28  
 
 
1234567...29

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型号 品牌 描述 获取价格 数据表
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