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AD7191BRUZ-REEL

更新时间： 2024-02-26 06:06:07

品牌	Logo	应用领域
罗彻斯特 - ROCHESTER		光电二极管
页数	文件大小	规格书
21页	1281K
描述
1-CH 24-BIT DELTA-SIGMA ADC, SERIAL ACCESS, PDSO24, ROHS COMPLIANT, PLASTIC, MO-153AD, TSSOP-24

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AD7191BRUZ-REEL 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	24
Reach Compliance Code：	unknown	风险等级：	5.77
Is Samacsys：	N	最大模拟输入电压：	5 V
最小模拟输入电压：	-5 V	转换器类型：	ADC, DELTA-SIGMA
JESD-30 代码：	R-PDSO-G24	JESD-609代码：	e3
长度：	7.8 mm	最大线性误差 (EL)：	0.001%
湿度敏感等级：	1	模拟输入通道数量：	1
位数：	24	功能数量：	1
端子数量：	24	最高工作温度：	105 °C
最低工作温度：	-40 °C	输出位码：	BINARY, OFFSET BINARY
输出格式：	SERIAL	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	225
采样速率：	0.0048 MHz	座面最大高度：	1.2 mm
标称供电电压：	5 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	4.4 mm	Base Number Matches：	1

AD7191BRUZ-REEL 数据手册

AD7191

Pin No.

Mnemonic

Description

AV_DD

Analog Supply Voltage, 3 V to 5.25 V. AV_DDis independent of DV_DD. Therefore, DV_DDcan be operated at 3 V

with AV_DDat 5 V or vice versa.

DV_DD

Digital Supply Voltage, 2.7 V to 5.25 V. DV_DDis independent of AV_DD. Therefore, AV_DDcan be operated at 3 V

with DV_DDat 5 V or vice versa.

ODR1

DOUTꢀRDY

Output Data Rate, Digital Input Pin. This pin is used with ODR2 to select the output data rate. See Table 5.

Serial Data OutputꢀData Ready Output. DOUTꢀRDYserves a dual purpose. It functions as a serial data

output pin to access the data conversions from the ADC. In addition, DOUTꢀRDYoperates as a data ready

pin, going low to indicate the completion of a conversion. If the data is not read after the conversion, the

pin goes high before the next update occurs. The serial interface is reset each time that a conversion is

available. The DOUTꢀRDY falling edge can be used as an interrupt to a processor, indicating that valid data

is available. With an external serial clock, the data can be read using the DOUTꢀRDY pin. Data is placed on

the DOUTꢀRDY pin on the SCLK falling edge and is valid on the SCLK rising edge.

ODR2

Output Data Rate, Digital Input Pin. This pin is used with ODR1 to select the output data rate. See Table 5.

Rev. 0 | Page ꢁ of 20

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型号	品牌	获取价格	描述	数据表
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AD7192BRUZ-REEL	ADI	获取价格	4.8 kHz, Ultralow Noise, 24-Bit Sigma-Delta ADC with PGA
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