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AD5381BST

更新时间： 2024-02-28 04:00:50
品牌 Logo 应用领域
亚德诺 - ADI 输入元件转换器
页数 文件大小 规格书
40页 680K
描述
IC SERIAL, PARALLEL, WORD INPUT LOADING, 6 us SETTLING TIME, 12-BIT DAC, PQFP100, 14 X 14 MM, LQFP-100, Digital to Analog Converter

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AD5381BST 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：14 X 14 MM, LQFP-100
针数：100Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.79最大模拟输出电压：5 V
最小模拟输出电压：转换器类型：D/A CONVERTER
输入位码：BINARY输入格式：SERIAL, PARALLEL, WORD
JESD-30 代码：S-PQFP-G100JESD-609代码：e0
长度：14 mm最大线性误差 (EL)：0.0244%
位数：12功能数量：1
端子数量：100最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装等效代码：QFP100,.63SQ,20
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3/5,5 V
认证状态：Not Qualified座面最大高度：1.55 mm
最大稳定时间：8 µs标称安定时间 (tstl)：6 µs
子类别：Other Converters标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：14 mmBase Number Matches：1

AD5381BST 数据手册

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Data Sheet  
AD5381  
GENERALDESCRIPTION  
The AD5381 is a complete, single-supply, 40-channel, 12-bit  
denseDAC® availablein a 100-lead LQFP package. All 40 channels  
have an on-chip outputamplifier with rail-to-rail operation.  
The AD5381 includes a programmableinternal 1.25 V/2.5 V,  
10 ppm/°C reference, an on-chip channel monitorfunction that  
multiplexes the analog outputs to a common MON_OUT pin  
for external monitoring, and an output amplifier boost mode,  
which allowsoptimization of the amplifierslew rate. The AD5381  
An input register followed bya DACregister providesdouble  
buffering, allowing the DACoutputsto be updated independ-  
ently or simultaneously using the  
input.  
LDAC  
Each channelhas a programmablegain and offset adjust  
register that allows the userto fully calibrate any DACchan-  
nel. Power consumption is typically 0.25mA/channel with  
boost mode disabled.  
contains a double-buffered parallelinterface featuring 20 ns  
WR  
pulse width, an SPI-/QSPI-/MICROWIRE-/DSP-compatible serial  
interface with interface speeds in excess of 30MHz, and an I2C-  
compatible interface that supports a 400kHzdata transfer rate.  
Table 1. Other Low Voltage Single-Supply DACs inProduct Family  
Linearity Error Package  
Model  
Resolution AVDD Range  
Output Channels  
(LSB)  
Description  
Package Option  
ST-100  
ST-100  
ST-100  
ST-100  
ST-100  
ST-100  
ST-52  
CP-64  
ST-52  
CP-64  
ST-52  
AD5380BSTZ-5  
AD5380BSTZ-3  
AD5382BSTZ-5  
AD5382BSTZ-3  
AD5383BSTZ-5  
AD5383BSTZ-3  
AD5390BSTZ-5  
AD5390BCPZ-5  
AD5390BSTZ-3  
AD5390BCPZ-3  
AD5391BSTZ-5  
AD5391BCPZ-5  
AD5391BSTZ-3  
AD5391BCPZ-3  
AD5392BSTZ-5  
AD5392BCPZ-5  
AD5392BSTZ-3  
AD5392BCPZ-3  
14 Bits  
14 Bits  
14 Bits  
14 Bits  
12 Bits  
12 Bits  
14 Bits  
14 Bits  
14 Bits  
14 Bits  
12 Bits  
12 Bits  
12 Bits  
12 Bits  
14 Bits  
14 Bits  
14 Bits  
14 Bits  
4.5 V to 5.5 V  
2.7 V to 3.6 V  
4.5 V to 5.5 V  
2.7 V to 3.6 V  
4.5 V to 5.5 V  
2.7 V to 3.6 V  
4.5 V to 5.5 V  
4.5 V to 5.5 V  
2.7 V to 3.6 V  
2.7 V to 3.6 V  
4.5 V to 5.5 V  
4.5 V to 5.5 V  
2.7 V to 3.6 V  
2.7 V to 3.6 V  
4.5 V to 5.5 V  
4.5 V to 5.5 V  
2.7 V to 3.6 V  
2.7 V to 3.6 V  
40  
40  
32  
32  
32  
32  
16  
16  
16  
16  
16  
16  
16  
16  
8
4
4
100-Lead LQFP  
100-Lead LQFP  
100-Lead LQFP  
100-Lead LQFP  
100-Lead LQFP  
100-Lead LQFP  
52-Lead LQFP  
64-Lead LFCSP  
52-Lead LQFP  
64-Lead LFCSP  
52-Lead LQFP  
64-Lead LFCSP  
52-Lead LQFP  
64-Lead LFCSP  
52-Lead LQFP  
64-Lead LFCSP  
52-Lead LQFP  
64-Lead LFCSP  
4
4
1
1
3
3
4
4
1
1
1
1
3
CP-64  
ST-52  
CP-64  
ST-52  
8
8
8
3
4
4
CP-64  
ST-52  
CP-64  
Rev. D | Page 3 of 40  
 
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