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AD5301BRTZ-500RL7

更新时间： 2024-01-10 03:11:02
品牌 Logo 应用领域
亚德诺 - ADI 光电二极管转换器
页数 文件大小 规格书
24页 473K
描述
2.5 V to 5.5 V, 120 µA, 2-Wire Interface, Voltage-Output 8-Bit DAC

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AD5301BRTZ-500RL7 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：LSSOP, TSOP6,.11,37针数：6
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：1.15
最大模拟输出电压：5.499 V最小模拟输出电压：0.001 V
转换器类型：D/A CONVERTER输入位码：BINARY
输入格式：SERIALJESD-30 代码：R-PDSO-G6
JESD-609代码：e4长度：2.9 mm
最大线性误差 (EL)：0.3906%湿度敏感等级：1
位数：8功能数量：1
端子数量：6最高工作温度：105 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：LSSOP封装等效代码：TSOP6,.11,37
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, LOW PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260电源：3/5 V
认证状态：Not Qualified座面最大高度：1.45 mm
最大稳定时间：8 µs标称安定时间 (tstl)：6 µs
子类别：Other Converters最大压摆率：0.25 mA
标称供电电压：3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.95 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：1.6 mm
Base Number Matches：1

AD5301BRTZ-500RL7 数据手册

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Data Sheet  
AD5301/AD5311/AD5321  
PIN CONFIGURATIONS AND FUNCTION DESCRIPTIONS  
V
GND  
SDA  
SCL  
1
2
3
6
5
4
DD  
V
AD5301/  
AD5311/  
AD5321  
DD  
1
2
3
4
8
7
6
5
GND  
SDA  
SCL  
PD  
AD5301/  
AD5311/  
AD5321  
A0  
A0  
V
A1  
TOP VIEW  
TOP VIEW  
(Not to Scale)  
V
OUT  
(Not to Scale)  
OUT  
Figure 3. 8-Lead MSOP (RM-8) Pin Configuration  
Figure 4. 6-Lead SOT-23 (RJ-6) Pin Configuration  
Table 5. Pin Function Descriptions  
Pin No.  
MSOP SOT-23  
Mnemonic Description  
1
6
VDD  
Power Supply Input. These parts can be operated from 2.5 V to 5.5 V and the supply should be  
decoupled with a 10 μF in parallel with a 0.1 μF capacitor to GND.  
2
3
4
5
5
A0  
Address Input. Sets the least significant bit of the 7-bit slave address.  
Not applicable A1  
Address Input. Sets the second least significant bit of the 7-bit slave address.  
Buffered Analog Output Voltage from the DAC. The output amplifier has rail-to-rail operation.  
4
VOUT  
Not applicable PD  
Active Low Control Input. Acts as a hardware power-down option. This pin overrides any software  
power-down option. The DAC output goes three-state and the current consumption of the part  
drops to 50 nA at 3 V (200 nA at 5 V).  
6
7
3
2
SCL  
Serial Clock Line. This is used in conjunction with the SDA line to clock data into the 16-bit input  
shift register. Clock rates of up to 400 kbps can be accommodated in the I2C-compatible interface.  
SCL may be CMOS/TTL driven.  
Serial Data Line. This is used in conjunction with the SCL line to clock data into the 16-bit input  
shift register during the write cycle and to read back one or two bytes of data (one byte for the  
AD5301, two bytes for the AD5311/AD5321) during the read cycle. It is a bidirectional open-drain  
data line that should be pulled to the supply with an external pull-up resistor. If not used in  
readback mode, SDA may be CMOS/TTL driven.  
SDA  
8
1
GND  
Ground Reference Point for All Circuitry on the Device.  
Rev. C | Page 7 of 24  
 
1...45678910...24

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