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A80L960JA-25

更新时间: 2024-01-11 10:38:50
品牌 Logo 应用领域
英特尔 - INTEL 时钟外围集成电路装置
页数 文件大小 规格书
16页 157K
描述
RISC Microprocessor, 32-Bit, 25MHz, CMOS, CPGA132, PGA-132

A80L960JA-25 技术参数

是否Rohs认证:不符合生命周期:Obsolete
零件包装代码:PGA包装说明:PGA, PGA132,14X14
针数:132Reach Compliance Code:unknown
风险等级:5.92Is Samacsys:N
其他特性:OPERATING CASE TEMPERATURE 0 TO 100地址总线宽度:32
位大小:32边界扫描:YES
最大时钟频率:25 MHz外部数据总线宽度:32
格式:FIXED POINT集成缓存:NO
JESD-30 代码:S-CPGA-P132JESD-609代码:e0
长度:37.08 mm低功率模式:YES
DMA 通道数量:外部中断装置数量:9
串行 I/O 数:端子数量:132
片上数据RAM宽度:8最高工作温度:100 °C
最低工作温度:封装主体材料:CERAMIC, METAL-SEALED COFIRED
封装代码:PGA封装等效代码:PGA132,14X14
封装形状:SQUARE封装形式:GRID ARRAY
峰值回流温度(摄氏度):NOT SPECIFIED电源:3.3 V
认证状态:Not QualifiedRAM(字数):1000
座面最大高度:4.57 mm速度:25 MHz
子类别:Microprocessors最大压摆率:284 mA
最大供电电压:3.6 V最小供电电压:3 V
标称供电电压:3.3 V表面贴装:NO
技术:CMOS温度等级:OTHER
端子面层:Tin/Lead (Sn/Pb)端子形式:PIN/PEG
端子节距:2.54 mm端子位置:PERPENDICULAR
处于峰值回流温度下的最长时间:NOT SPECIFIED宽度:37.08 mm
uPs/uCs/外围集成电路类型:MICROPROCESSOR, RISCBase Number Matches:1

A80L960JA-25 数据手册

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80L960JA/JF Microprocessor  
Table 7. 80L960JA/JF AC Characteristics (16 MHz) (Sheet 1 of 2)  
Symbol  
Parameter  
Min  
Max  
Units  
Notes  
INPUT CLOCK TIMINGS  
TF  
CLKIN Frequency  
8
16.67  
MHz  
ns  
TC  
CLKIN Period  
60  
125  
TCS  
TCH  
TCL  
TCR  
TCF  
CLKIN Period Stability  
CLKIN High Time  
CLKIN Low Time  
CLKIN Rise Time  
CLKIN Fall Time  
± 250  
ps  
(1,2)  
18  
18  
ns  
Measured at 1.5 V (1)  
Measured at 1.5 V (1)  
0.8 V to 2.0 V (1)  
ns  
6
6
ns  
ns  
2.0 V to 0.8 V (1)  
SYNCHRONOUS OUTPUT TIMINGS  
Output Valid Delay, Except  
ALE/ALE# Inactive and  
DT/R#  
TOV1  
4.0  
21  
ns  
(3)  
(4)  
TOV2  
TOF  
Output Valid Delay, DT/R#  
Output Float Delay  
0.5 TC + 4.0  
4.0  
0.5 TC +21  
19  
ns  
ns  
SYNCHRONOUS INPUT TIMINGS  
Input Setup to CLKIN —  
AD[31:0], NMI#, XINT[7:0]#  
TIS1  
TIH1  
TIS2  
TIH2  
TIS3  
TIH3  
TIS4  
TIH4  
10  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
(5)  
(5)  
(6)  
(6)  
(7)  
(7)  
(8)  
(8)  
Input Hold from CLKIN —  
AD[31:0], NMI# XINT[7:0]#  
1
11  
1
Input Setup to CLKIN —  
RDYRCV# and HOLD  
Input Hold from CLKIN —  
RDYRCV# and HOLD  
Input Setup to CLKIN —  
RESET#  
8
Input Hold from CLKIN —  
RESET#  
1
Input Setup to RESET# —  
ONCE#, STEST  
8
Input Hold from RESET# —  
ONCE#, STEST  
1
RELATIVE OUTPUT TIMINGS  
TLXL  
TLXA  
TDXD  
ALE/ALE# Width  
0.5TC - 8  
ns  
ns  
ns  
(9)  
Address Hold from ALE/ALE#  
Inactive  
0.5TC - 8  
0.5TC - 8  
Equal Loading (9)  
Equal Loading (9)  
DT/R# Valid to DEN# Active  
NOTE: Refer to Table 8 for note definitions for this table.  
Preliminary Online Information, August 1998  
7

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