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A1225XL-2PL84I

更新时间： 2024-01-27 10:13:09

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美高森美 - MICROSEMI		时钟栅可编程逻辑
页数	文件大小	规格书
84页	4582K
描述
Field Programmable Gate Array, 200MHz, 451-Cell, CMOS, PQCC84,

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A1225XL-2PL84I 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
Reach Compliance Code：	compliant	风险等级：	5.87
最大时钟频率：	200 MHz	JESD-30 代码：	S-PQCC-J84
输入次数：	72	逻辑单元数量：	451
输出次数：	72	端子数量：	84
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装等效代码：	LDCC84,1.2SQ	封装形状：	SQUARE
封装形式：	CHIP CARRIER	电源：	5 V
可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY	认证状态：	Not Qualified
子类别：	Field Programmable Gate Arrays	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	J BEND
端子节距：	1.27 mm	端子位置：	QUAD

A1225XL-2PL84I 数据手册

Integrator Series FPGAs: 1200XL and 3200DX Families

Package Pin Assignments (continued)

176-Pin CPGA (Top View)

10 11 12 13 14 15

176-Pin

CPGA

10 11 12 13 14 15

Signal

Pad Number

Location

PRA or I/O

PRB or I/O

MODE

152

160

B14

SDI or I/O

DCLK or I/O

CLKA or I/O

CLKB or I/O

GND

135

175

154

158

1, 8, 18, 23, 33, 38, 45, 57, 67, 77, 89

101, 106, 111, 121, 126, 133, 145, 156, 165

D4, E4, G4, H4, K4, L4, M4, M6, M8, M10, M12

K12, J12, J13, H12, F12, E12, D12, D10, C8, D6

13, 24, 28, 52, 68, 82, 112, 116, 140, 155, 170

F4, H2, H3, J4, M5, N8, M11, J14, H13, H14, G12, D11, D8, D5

Notes:

1. Unused I/O pins are designated as outputs by ALS and are driven LOW.

2. All unassigned pins are available for use as I/Os.

3. MODE = GND, except during device programming or debugging.

Discontinued – v3.0

1...75 76 777879 80 81...84

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