Datasheet > 微控制器和处理器 > 数字信号处理器> ADSP-21267SKSTZ-X

ADSP-21267SKSTZ-X

更新时间： 2024-02-13 12:08:39

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亚德诺 - ADI		/
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Preliminary Technical Data

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ADSP-21267SKSTZ-X 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	MS-026BFB, LQFP-144	针数：	144
Reach Compliance Code：	compliant	ECCN代码：	3A001.A.3
HTS代码：	8542.31.00.01	风险等级：	5.84
地址总线宽度：	16	桶式移位器：	YES
位大小：	32	边界扫描：	YES
最大时钟频率：	50 MHz	外部数据总线宽度：	16
格式：	FLOATING POINT	内部总线架构：	MULTIPLE
JESD-30 代码：	S-PQFP-G144	JESD-609代码：	e3
长度：	20 mm	低功率模式：	YES
端子数量：	144	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装等效代码：	QFP144,.87SQ,20
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	1.2,3.3 V
认证状态：	Not Qualified	RAM（字数）：	32768
座面最大高度：	1.6 mm	子类别：	Digital Signal Processors
最大供电电压：	1.26 V	最小供电电压：	1.14 V
标称供电电压：	1.2 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	20 mm
uPs/uCs/外围集成电路类型：	DIGITAL SIGNAL PROCESSOR, OTHER	Base Number Matches：	1

ADSP-21267SKSTZ-X 数据手册

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SHARC^®Processor

ADSP-21267

Preliminary Technical Data

DAI incorporates two precision clock generators (PCG), and

an input data port (IDP) that includes a parallel data acqui-

sition port (PDAP), and three programmable timers, all

under software control by the signal routing unit (SRU)

On-chip memory—1M Bit of on-chip SRAM and a dedicated

3M Bits of on-chip mask-programmable ROM

The ADSP-21267 is available with a 150 MHz core instruction

rate. For complete ordering information, see Ordering

Guide on page 43

SUMMARY

High performance 32-bit/40-bit floating point processor

optimized for high performance audio processing

Code compatible with all other SHARC DSPs

The ADSP-21267 processes high performance audio while

enabling low system costs

Audio decoders and post processor-algorithms support.

Non-volatile memory can be configured to contain a com-

bination of PCM 96 kHz, Dolby Digital, Dolby Digital EX2,

Dolby Pro Logic IIx, DTS 5.1, DTS ES Discrete 6.1, DTS-ES

Matrix 6.1, DTS Neo:6, MPEG2x BC (2 channel) and others.

See www.analog.com/SHARC for a complete list

Single-Instruction Multiple-Data (SIMD) computational archi-

tecture—two 32-bit IEEE floating-point/32-bit fixed-point/

40-bit extended precision floating point computational

units, each with a multiplier, ALU, shifter, and register file

High bandwidth I/O —a parallel port, an SPI port, four serial

ports, a digital audio interface (DAI) and JTAG test port

Figure 1. FUNCTIONAL BLOCK DIAGRAM

CORE PROCESSOR

DUAL PORTED MEMORY

BLOCK 0

DUAL P ORT ED ME MORY

BLOCK 1

INSTRUCTION

CACHE

32 X 48-BIT

SRAM

0.5 MBIT

SRAM

0.5 MBIT

TIMER

ROM

1.5 MBIT

DAG1

8X4X32

DAG2

8X4X32

PROGRAM

SEQUENCER

ADDR

DATA

ADDR

DATA

PM ADDRESS BUS

DM ADDRESS BUS

PM DATA BUS

DM DATA BUS

IOD

(32)

IOA

(1 8)

DMA CONTROLLER

22 CHANNELS

PX REGISTER

GPIO FLAGS/

IRQ/TIMEXP

PROCESSING

ELEMENT

(PEX)

PROCESSING

ELEMENT

(PEY)

SPI PORT (1)

ADDRE SS/

D ATA BUS/ GP IO

CON TR OL/G PIO

PARALLEL

PORT

SERIAL PORTS (6)

JTAG TEST & EMULATION

IOP

REGISTERS

(MEMORY MAPPED)

SIGNAL

ROUTING

UNIT

INPUT

DATA PORTS (8)

PARALLEL DATA

ACQUISITION PORT

CONTROL,

STATUS, &

DAT A BUFFERS

PRECISION CLOCK

GENERATORS (2)

TI ME RS (3)

DIGITAL AUDIO INTERFACE

I/O PROCESSOR

SHARC and the SHARC logo are registered trademarks of Analog Devices, Inc.

Rev. PrA

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However, no responsibility is assumed by Analog Devices for its use, nor for any

infringements of patents or other rights of third parties that may result from its use.

Specifications subject to change without notice. No license is granted by implication

or otherwise under any patent or patent rights of Analog Devices. Trademarks and

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One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106 U.S.A.

Tel:781/329-4700 www.analog.com

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