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9FGP205AKLFT

更新时间： 2024-02-10 19:15:56

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艾迪悌 - IDT		/
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Frequency Timing Generator for Peripherals

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9FGP205AKLFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Transferred	零件包装代码：	VFQFPN
包装说明：	HVQCCN, LCC40,.24SQ,20	针数：	40
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	4.51
Samacsys Description：	VFQFP-N 6.0 X 6.0 X 0.9 MM - NO LEAD	JESD-30 代码：	S-PQCC-N40
JESD-609代码：	e3	长度：	6 mm
湿度敏感等级：	3	端子数量：	40
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	400 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	HVQCCN	封装等效代码：	LCC40,.24SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：	260	电源：	3.3 V
主时钟/晶体标称频率：	25 MHz	认证状态：	Not Qualified
座面最大高度：	1 mm	子类别：	Clock Generators
最大压摆率：	225 mA	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	6 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC

9FGP205AKLFT 数据手册

9FGP205

Advance Information

Frequency Timing Generator for Peripherals

General SMBus serial interface information for the 9FGP205

How to Write:

How to Read:

• Controller (host) will send start bit.

• Controller (host) sends the write address D2_(H)

• ICS clock will acknowledge

• Controller (host) sends a start bit.

• Controller (host) sends the write address D2_(H)

• ICS clock will acknowledge

• Controller (host) sends the beginning byte location = N

• ICS clock will acknowledge

• Controller (host) sends the begining byte

location = N

• ICS clock will acknowledge

• Controller (host) sends the data byte count = X

• ICS clock will acknowledge

• Controller (host) starts sending Byte N through

Byte N + X -1

• Controller (host) will send a separate start bit.

• Controller (host) sends the read address D3_(H)

• ICS clock will acknowledge

• ICS clock will acknowledge each byte one at a time

• Controller (host) sends a Stop bit

• ICS clock will send the data byte count = X

• ICS clock sends Byte N + X -1

• ICS clock sends Byte 0 through byte X (if X_(H)

was written to byte 8).

• Controller (host) will need to acknowledge each byte

• Controller (host) will send a not acknowledge bit

• Controller (host) will send a stop bit

Index Block Write Operation

Index Block Read Operation

Controller (Host)

ICS (Slave/Receiver)

starT bit

Slave Address *D0_(H)

WRite

Beginning Byte = N

Data Byte Count = X

Beginning Byte N

ACK

Beginning Byte = N

Repeat starT

Slave Address *D1_(H)

ReaD

ACK

Data Byte Count = X

Beginning Byte N

ACK

Byte N + X - 1

ACK

stoP bit

Byte N + X - 1

Not acknowledge

stoP bit

* By default, SMBADR = 0,

therefore, SMBus WRITE/READ address is D0/D1.

Please see SMBus Address Selection table on page 1.

IDT^®Frequency Timing Generator for Peripherals

1664—05/14/10

1...9 10 111213 14 15...18

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9FGP205AKLFT 替代型号

型号	品牌	替代类型	描述	数据表
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