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9FG108DFILFT

更新时间： 2024-02-02 09:56:07
品牌 Logo 应用领域
艾迪悌 - IDT 晶体时钟发生器微控制器和处理器外围集成电路光电二极管PC
页数 文件大小 规格书
18页 165K
描述
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA

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9FG108DFILFT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSSOP
包装说明：TSSOP, TSSOP48,.3,20针数：48
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：1.4
JESD-30 代码：R-PDSO-G48JESD-609代码：e3
长度：12.5 mm湿度敏感等级：1
端子数量：48最高工作温度：70 °C
最低工作温度：最大输出时钟频率：400 MHz
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP48,.3,20封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：3.3 V主时钟/晶体标称频率：28 MHz
认证状态：Not Qualified座面最大高度：1.2 mm
子类别：Clock Generators最大压摆率：205 mA
最大供电电压：3.465 V最小供电电压：3.135 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Matte Tin (Sn) - annealed端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：6.1 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFICBase Number Matches：1

9FG108DFILFT 数据手册

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ICS9FG108D  
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA  
Pin Description (continued)  
PIN #  
PIN NAME  
PIN TYPE  
DESCRIPTION  
Active low input to stop differential output clocks.  
Asynchronous, active high input to enable spread spectrum functionality. This pin has  
a 120Kohm pull down resistor.  
Select 14.31818 MHz or 25 Mhz input frequency. This pin has an internal 120kohm  
pull up resistor.  
25  
DIF_STOP#  
IN  
26  
27  
vSPREAD  
IN  
IN  
^SEL14M_25M#  
1 = 14.31818 MHz, 0 = 25 MHz  
Active high input for enabling output 3. This pin has an internal 120kohm pull down  
resistor.  
28  
vOE_3  
IN  
0 = tri-state outputs, 1= enable outputs  
29  
30  
31  
32  
33  
DIF_3#  
DIF_3  
VDD  
DIF_2#  
DIF_2  
OUT  
OUT  
PWR  
OUT  
OUT  
0.7V differential Complementary clock output  
0.7V differential true clock output  
Power supply, nominal 3.3V  
0.7V differential Complementary clock output  
0.7V differential true clock output  
Active high input for enabling output 2. This pin has in internal 120kohm pull up  
resistor.  
34  
^OE_2  
IN  
0 = tri-state outputs, 1= enable outputs  
35  
36  
GND  
VDD  
PWR  
PWR  
Ground pin.  
Power supply, nominal 3.3V  
Active high input for enabling output 1. This pin has an internal 120kohm pull up  
resistor.  
37  
^OE_1  
IN  
0 = tri-state outputs, 1= enable outputs  
38  
39  
40  
41  
42  
DIF_1#  
DIF_1  
VDD  
DIF_0#  
DIF_0  
OUT  
OUT  
PWR  
OUT  
OUT  
0.7V differential Complementary clock output  
0.7V differential true clock output  
Power supply, nominal 3.3V  
0.7V differential Complementary clock output  
0.7V differential true clock output  
Active high input for enabling output 0. This pin has an internal 120kohm pull down  
resistor.  
43  
vOE_0  
IN  
0 = tri-state outputs, 1= enable outputs  
44  
45  
vFS1  
vFS0  
IN  
IN  
3.3V Frequency select latched input pin with internal 120kohm pull down resistor.  
3.3V Frequency select latched input pin with internal 120kohm pull down resistor.  
This pin establishes the reference current for the differential current-mode output pairs.  
This pin requires a fixed precision resistor tied to ground in order to establish the  
appropriate current. 475 ohms is the standard value.  
Ground pin for the PLL core.  
46  
IREF  
OUT  
47  
48  
GNDA  
VDDA  
PWR  
PWR  
3.3V power for the PLL core.  
Note:  
^ indicates internal 120K pull up  
v indicates internal 120K pull down  
IDTTM Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA  
1542E 12/16/10  
4
1234567...18

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