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9EX21501AKLFT

更新时间： 2024-02-25 20:05:49
品牌 Logo 应用领域
艾迪悌 - IDT 时钟驱动器复用器逻辑集成电路PC
页数 文件大小 规格书
15页 199K
描述
15 Output PCIe G2/QPI Differential Buffer with 2:1 Input Mux

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9EX21501AKLFT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：VFQFPN
包装说明：ROHS COMPLIANT, PLASTIC, MLF-64针数：64
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.82
Is Samacsys：N系列：21501
输入调节：DIFFERENTIAL MUXJESD-30 代码：S-PQCC-N64
JESD-609代码：e3长度：9 mm
逻辑集成电路类型：PLL BASED CLOCK DRIVER湿度敏感等级：3
功能数量：1反相输出次数：
端子数量：64实输出次数：15
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：HVQCCN封装等效代码：LCC64,.35SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：3.3 V
Prop。Delay @ Nom-Sup：5.2 ns认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.15 ns座面最大高度：1 mm
子类别：Clock Drivers最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES温度等级：COMMERCIAL
端子面层：Matte Tin (Sn) - annealed端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：9 mm
Base Number Matches：1

9EX21501AKLFT 数据手册

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9EX21501  
Datasheet  
15 Output PCIe G2/QPI Differential Buffer with 2:1 Input Mux  
Pin Description (continued)  
41 DIF_4  
OUT  
0.7V differential true clock output  
42 DIF_4#  
OUT  
0.7V differential complement clock output  
Active low input for enabling DIF pair 5.  
1 = tri-state outputs, 0 = enable outputs  
0.7V differential true clock output  
0.7V differential complement clock output  
Active low input for enabling DIF pair 6.  
1 = tri-state outputs, 0 = enable outputs  
0.7V differential true clock output  
43 OE5#  
IN  
44 DIF_5  
45 DIF_5#  
OUT  
OUT  
46 OE6#  
IN  
47 DIF_6  
48 DIF_6#  
49 VDD  
OUT  
OUT  
PWR  
0.7V differential complement clock output  
Power supply, nominal 3.3V  
Active low input for enabling DIF pair 7.  
1 = tri-state outputs, 0 = enable outputs  
0.7V differential true clock output  
50 OE7#  
IN  
51 DIF_7  
52 DIF_7#  
53 100M_133M#  
OUT  
OUT  
IN  
0.7V differential complement clock output  
Input to select operating frequency. See Frequency/Functionality Table for functionality of this pin.  
Trilevel input to select High BW, Bypass Mode or Low BW.  
0 = Low BW Mode, Mid= Bypass Mode, 1 = High Bandwidth  
Clock pin of SMBUS circuitry, 5V tolerant  
Data pin of SMBUS circuitry, 5V tolerant  
SMBus address bit 1  
54 HIBW_BYPM_LOBW#  
IN  
55 SMBCLK  
56 SMBDAT  
57 SMB_A1  
58 SMB_A0  
IN  
I/O  
IN  
IN  
SMBus address bit 0 (LSB)  
Input to select differential input clock A or differential input clock B.  
0 = Input B selected, 1 = Input A selected.  
59 SEL_A_B#  
IN  
60 CKPWRGD/PD#  
61 DIF_8  
62 DIF_8#  
IN  
OUT  
OUT  
Notifies the clock to sample latched inputs on the rising edge, and to power down on the falling edge.  
0.7V differential true clock output  
0.7V differential complement clock output  
Active low input for enabling DIF pair 8.  
1 = tri-state outputs, 0 = enable outputs  
Power supply, nominal 3.3V  
63 OE8#  
64 VDD  
IN  
PWR  
IDT® 15 Output PCIe G2/QPI Differential Buffer with 2:1 Input Mux  
1578—01/18/11  
4
1234567...15

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