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874004AG

更新时间： 2024-02-16 08:04:16

品牌	Logo	应用领域
艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
10页	562K
描述
Clock Driver, 874004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, MO-153, TSSOP-24

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874004AG 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	4.40 X 7.80 MM, 0.92 MM HEIGHT, MO-153, TSSOP-24
针数：	24	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.92	系列：	874004
输入调节：	DIFFERENTIAL	JESD-30 代码：	R-PDSO-G24
JESD-609代码：	e0	长度：	7.8 mm
逻辑集成电路类型：	CLOCK DRIVER	湿度敏感等级：	1
功能数量：	1	反相输出次数：
端子数量：	24	实输出次数：	4
最高工作温度：	70 °C	最低工作温度：
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	240
认证状态：	Not Qualified	座面最大高度：	1.2 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	4.4 mm	最小 fmax：	98 MHz
Base Number Matches：	1

874004AG 数据手册

PRELIMINARY

ICS874004

Integrated

Circuit

Systems, Inc.

PCI EXPRESS

™

ITTER

ATTENUATOR

APPLICATION INFORMATION

POWER SUPPLY FILTERING TECHNIQUES

As in any high speed analog circuitry, the power supply pins

are vulnerable to random noise. The ICS874004 provides

separate power supplies to isolate any high switching

noise from the outputs to the internal PLL.V_DD, V_DDA, and V_DDO

should be individually connected to the power supply

plane through vias, and bypass capacitors should be

used for each pin. To achieve optimum jitter performance,

power supply isolation is required. Figure 1 illustrates how

a 10Ω resistor along with a 10µF and a .01µF bypass

capacitor should be connected to each V_DDApin.

3.3V

V_DD

.01µF

10Ω

V_DDA

.01µF

10µF

FIGURE 1. POWER SUPPLY FILTERING

WIRING THE DIFFERENTIAL INPUT TO ACCEPT SINGLE ENDED LEVELS

Figure 2 shows how the differential input can be wired to accept of R1 and R2 might need to be adjusted to position theV_REF in

single ended levels. The reference voltage V_REF = V_DD/2 is the center of the input voltage swing. For example, if the input

generated by the bias resistors R1, R2 and C1.This bias circuit clock swing is only 2.5V andV_DD= 3.3V,V_REF should be 1.25V

should be located as close as possible to the input pin.The ratio and R2/R1 = 0.609.

VDD

Single Ended Clock Input

CLK

V_REF

nCLK

0.1u

FIGURE 2. SINGLE ENDED SIGNAL DRIVING DIFFERENTIAL INPUT

874004AG

www.icst.com/products/hiperclocks.html

REV. A FEBRUARY 2, 2005

1...3 4 567 8 9 10

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型号	品牌	描述	获取价格	数据表
874004AGT	IDT	Clock Driver, 874004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO24, 4.40 X 7.80 M	获取价格
874005AG	IDT	PLL Based Clock Driver, 874005 Series, 5 True Output(s), 0 Inverted Output(s), PDSO24, 4.4	获取价格
874005AG-04LF	IDT	PCI EXPRESS™ JITTER ATTENUATOR	获取价格
874005AG-04LFT	IDT	PCI EXPRESS™ JITTER ATTENUATOR	获取价格
874005AGT	IDT	PLL Based Clock Driver, 874005 Series, 5 True Output(s), 0 Inverted Output(s), PDSO24, 4.4	获取价格
8740060U1000	ETC	22 AWG solid tinned copper conductors, PVC insulation,	获取价格

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