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8440258AKI-46LF

更新时间： 2024-01-13 21:35:02

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艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
16页	695K
描述
Clock Generator, 125MHz, 5 X 5 MM, 0.75 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD-2, VFQFN-32

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8440258AKI-46LF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFN
包装说明：	5 X 5 MM, 0.75 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD-2, VFQFN-32	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.26
JESD-30 代码：	S-XQCC-N32	JESD-609代码：	e3
长度：	5 mm	端子数量：	32
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	125 MHz	封装主体材料：	UNSPECIFIED
封装代码：	VQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	25 MHz	认证状态：	Not Qualified
座面最大高度：	1 mm	最大供电电压：	2.625 V
最小供电电压：	2.375 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	5 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

8440258AKI-46LF 数据手册

ICS8440258I-46

FEMTOCLOCK™ CRYSTAL/LVCMOS-TO-LVDS/ LVCMOS FREQUENCY SYNTHESIZER

PRELIMINARY

TABLE 3C. LVDS DC CHARACTERISTICS, V_DD= V_DDA= V_DDO1= V_DDO2= 2.5V 5ꢀ,TA = -40°C TO 85°C

Symbol Parameter

Test Conditions

Minimum

Typical

390

Maximum Units

V_OD

Differential Output Voltage

∆ V_OD

V_OS

V_ODMagnitude Change

Offset Voltage

1.25

∆ V_OS

V_OSMagnitude Change

TABLE 4. CRYSTAL CHARACTERISTICS

Parameter

Test Conditions

Minimum

Fundamental

Typical Maximum Units

Mode of Oscillation

Frequency

MHz

Ω

Equivalent Series Resistance (ESR)

Shunt Capacitance

Drive Level

NOTE: Characterized using an 18pF parallel resonant crystal.

TABLE 5. AC CHARACTERISTICS, V_DD= V_DDA= V_DDO1= V_DDO2= 2.5V 5ꢀ,TA = -40°C TO 85°C

Symbol Parameter Test Conditions Minimum Typical Maximum Units

Q0:3/nQ0:3

Q4, Q5

125

MHz

f_OUT

Output Frequency

Q6, Q7

Q0:3/nQ0:3

Q4:Q7

Output Skew;

NOTE 1, 2

tsk(o)

tjit(Ø)

t_R/ t_F

odc

Q0:3/nQ0:3 125MHz, (1.875MHz - 20MHz)

0.34

0.37

480

1.4

RMS Phase Jitter

(Random); NOTE 3

Q4, Q5

125MHz, (1.875MHz - 20MHz)

20ꢀ to 80ꢀ

Q0:3/nQ0:3

Q4:Q7

Output

Rise/Fall Time

20ꢀ to 80ꢀ

Q0:3/nQ0:3

Q4:Q7

ꢀ

Output Duty Cycle

ꢀ

NOTE 1: Defined as skew between outputs at the same supply voltages and with equal load conditions.

Measured at V_DDOX/2.

NOTE 2: This parameter is defined in accordance with JEDEC Standard 65.

NOTE 3: Please refer to the Phase Noise Plot.

IDT^™/ ICS^™LVDS/LVCMOS FREQUENCY SYNTHESIZER

ICS8440258AKI-46 REVA OCTOBER 13, 2006

1 2 345 6 7...16

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