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8440258AKI-46LF

更新时间： 2024-02-13 22:32:24

品牌	Logo	应用领域
艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
16页	695K
描述
Clock Generator, 125MHz, 5 X 5 MM, 0.75 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD-2, VFQFN-32

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8440258AKI-46LF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFN
包装说明：	5 X 5 MM, 0.75 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD-2, VFQFN-32	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.26
JESD-30 代码：	S-XQCC-N32	JESD-609代码：	e3
长度：	5 mm	端子数量：	32
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	125 MHz	封装主体材料：	UNSPECIFIED
封装代码：	VQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	25 MHz	认证状态：	Not Qualified
座面最大高度：	1 mm	最大供电电压：	2.625 V
最小供电电压：	2.375 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	5 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

8440258AKI-46LF 数据手册

ICS8440258I-46

FEMTOCLOCK™ CRYSTAL/LVCMOS-TO-LVDS/ LVCMOS FREQUENCY SYNTHESIZER

PRELIMINARY

TABLE 1. PIN DESCRIPTIONS

Number

Name

Type

Description

1, 2

Q0, nQ0

Output

Differential clock outputs. LVDS interface levels.

3, 12, 16,

17, 21

GND

Power

Power supply ground.

4, 5

6, 11, 27

7, 8

Q1, nQ1

V_DD

Output

Power

Output

Differential clock outputs. LVDS interface levels.

Core supply pin.

Q2, nQ2

Q3, nQ3

Differential clock outputs. LVDS interface levels.

9, 10

13, 15,

18, 20

Q4, Q5,

Q6, Q7

Output

Single-ended clock outputs. LVCMOS/LVTTL interface levels.

V_DDO1

V_DDO2

Power

Power output supply pin for Q4 and Q5 LVCMOS outputs.

Power output supply pin for Q6 and Q7 LVCMOS outputs.

No connect.

22, 23, 24

Unused

Power

V_DDA

Analog supply pin.

PLL Bypass. When LOW, the output is driven from the VCO output.

When HIGH, the PLL is bypassed and the output frequency =

reference clock frequency/N output divider.

nPLL_SEL

Input

Pulldown

LVCMOS/LVTTL interface levels.

Active HIGH Master Reset. When logic HIGH, the internal dividers are

Input

Pulldown reset causing the outputs to go low. When logic LOW, the internal

dividers and the outputs are enabled. LVCMOS/LVTTL interface levels.

REF_CLK

nXTAL_SEL

Pulldown Single-ended LVCMOS/LVTTL reference clock input.

Selects between the crystal or REF_CLK inputs as the PLL reference

Pulldown source. When HIGH, selects REF_CLK. When LOW, selects XTAL

inputs. LVCMOS/LVTTL interface levels.

31,

XTAL_OUT,

XTAL_IN

Crystal oscillator interface. XTAL_OUT is the output.

XTAL_IN is the input.

Input

NOTE: Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.

TABLE 2. PIN CHARACTERISTICS

Symbol Parameter

Test Conditions

Minimum Typical Maximum Units

C_IN

Input Capacitance

Power Dissipation Capacitance

kΩ

Ω

C_PD

R_PULLDOWNInput Pulldown Resistor

R_OUTOutput Impedance

IDT^™/ ICS^™LVDS/LVCMOS FREQUENCY SYNTHESIZER

ICS8440258AKI-46 REVA OCTOBER 13, 2006

123 4 5 6 7...16

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