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844003AKI-02T

更新时间： 2024-01-30 10:21:20

品牌	Logo	应用领域
艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
16页	320K
描述
Clock Generator, 700MHz, 5 X 5 MM, 0.75 MM HEIGHT, MO-220, VFQFN-32

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844003AKI-02T 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	32
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.32
Is Samacsys：	N	JESD-30 代码：	S-XQCC-N32
JESD-609代码：	e0	长度：	5 mm
端子数量：	32	最高工作温度：	85 °C
最低工作温度：	-40 °C	最大输出时钟频率：	700 MHz
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：	225	主时钟/晶体标称频率：	25 MHz
认证状态：	Not Qualified	座面最大高度：	1 mm
最大供电电压：	3.63 V	最小供电电压：	2.97 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	TIN LEAD	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	5 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

844003AKI-02T 数据手册

ICS844003I-02

FEMTOCLOCKS™ CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER

PRELIMINARY

TABLE 4D. LVDS DC CHARACTERISTICS, V_DD= V_{DDO_A}= V_{DDO_B}= 3.3V 10ꢀ, TA = -40°C TO 85°C

Symbol Parameter

Test Conditions

Minimum

Typical

400

Maximum Units

V_OD

Differential Output Voltage

Δ V_OD

V_OS

V_ODMagnitude Change

Offset Voltage

1.35

Δ V_OS

V_OSMagnitude Change

TABLE 5. CRYSTAL CHARACTERISTICS

Parameter

Test Conditions

Minimum Typical Maximum Units

Mode of Oscillation

Fundamental

FB_DIV = ÷20

Frequency

31.25

29.167

MHz

FB_DIV = ÷24

23.33

26.04166

Equivalent Series Resistance (ESR)

Shunt Capacitance

Drive Level

100

µW

NOTE: Characterized using an 18pF parallel resonant crystal.

TABLE 6. AC CHARACTERISTICS, V_DD= V_{DDO_A}= V_{DDO_B}= 3.3V 10ꢀ, TA = -40°C TO 85°C

Symbol Parameter

Test Conditions

DIV_SELx[1:0] = 00

DIV_SELx[1:0] = 01

DIV_SELx[1:0] = 10

DIV_SELx[1:0] = 11

Minimum Typical Maximum Units

560

280

140

112

700

350

175

140

MHz

f_OUT

Output Frequency Range

tsk(b)

tsk(o)

Bank Skew, NOTE 1

TBD

0.34

0.38

0.34

0.42

0.50

0.41

325

Outputs @ Same Frequency

Outputs @ Different Frequencies

625MHz (1.875MHz - 20MHz)

500MHz (1.875MHz - 20MHz)

312.5MHz (1.875MHz - 20MHz)

250MHz (1.875MHz - 20MHz)

125MHz (1.875MHz - 20MHz)

100MHz (1.875MHz - 20MHz)

20ꢀ to 80ꢀ

Output Skew; NOTE 2, 4

RMS Phase Jitter (Random);

NOTE 3

tjit(Ø)

t_R/ t_F

odc

Output Rise/Fall Time

Output Duty Cycle

DIV_SELx[1:0] = 00

ꢀ

DIV_SELx[1:0] ≠ 00

ꢀ

NOTE 1: Defined as skew winthin a bank of outputs at the same voltages and with equal load conditions.

NOTE 2: Defined as skew between outputs at the same supply voltages and with equal load conditions.

Measured at the output differential cross points.

NOTE 3: Please refer to the Phase Noise Plots.

NOTE 4: This parameter is defined in accordance with JEDEC Standard 65.

IDT^™/ ICS^™LVDS FREQUENCY SYNTHESIZER

ICS844003AKI-02 REV. A FEBRUARY 22, 2007

1...3 4 567 8 9...16

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