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8421004AGI-01T

更新时间： 2024-01-10 09:44:12

品牌	Logo	应用领域
艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
16页	796K
描述
Clock Generator, 170MHz, PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, MO-153, TSSOP-24

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8421004AGI-01T 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Active	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP24,.25	针数：	24
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.21
Is Samacsys：	N	其他特性：	ALSO OPERATES AT 3.3V SUPPLY
JESD-30 代码：	R-PDSO-G24	JESD-609代码：	e0
长度：	7.8 mm	湿度敏感等级：	1
端子数量：	24	最高工作温度：	85 °C
最低工作温度：	-40 °C	最大输出时钟频率：	170 MHz
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP24,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	240
电源：	2.5/3.3 V	主时钟/晶体标称频率：	27.2 MHz
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	Clock Generators	最大压摆率：	113 mA
最大供电电压：	2.625 V	最小供电电压：	2.375 V
标称供电电压：	2.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

8421004AGI-01T 数据手册

ICS8421004I-01 Data Sheet

FEMTOCLOCK™ CRYSTAL-TO-HSTL FREQUENCY SYNTHESIZER

Table 1. Pin Descriptions

Number

1, 2

Name

nQ1, Q1

V_DDO

Type

Description

Output

Power

Output

Differential output pair. HSTL interface levels.

Output supply pins.

3, 22

4, 5

Q0, nQ0

Differential output pair. HSTL interface levels.

Active HIGH Master Reset. When logic HIGH, the internal dividers are reset

causing the true outputs Qx to go low and the inverted outputs nQx to go high.

When logic LOW, the internal dividers and the outputs are enabled.

LVCMOS/LVTTL interface levels.

Input

Pulldown

PLL select. When LOW, selects PLL (PLL enabled). When HIGH, the PLL is

bypassed. LVCMOS/LVTTL interface levels.

nPLL_SEL

Input

Pulldown

8, 18

Unused

Power

No connect.

V_DDA

Analog supply pin.

10,

F_SEL0,

F_SEL1

Input

Power

Input

Pulldown Frequency select pins. LVCMOS/LVTTL interface levels.

Core supply pins.

V_DD

13,

XTAL_OUT,

XTAL_IN

Parallel resonant crystal interface. XTAL_OUT is the output, XTAL_IN is the input.

15, 19

GND

Power

Input

Power supply ground.

REF_CLK

Pulldown Single-ended reference clock input. LVCMOS/LVTTL interface levels.

Selects between crystal or REF_CLK inputs as the PLL reference source. Selects

Pulldown XTAL inputs when LOW. Selects REF_CLK when HIGH. LVCMOS/LVTTL

interface levels.

nXTAL_SEL

Input

20, 21

23, 24

nQ3, Q3

Q2, nQ2

Output

Differential output pair. HSTL interface levels.

NOTE: Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.

Table 2. Pin Characteristics

Symbol

Parameter

Test Conditions

Minimum

Typical

Maximum

Units

C_IN

Input Capacitance

R_PULLDOWNInput Pulldown Resistor

kΩ

ICS8421004AGI-01 REVISION B NOVEMBER 20, 2009

123 4 5 6 7...16

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