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8402AYLFT

更新时间： 2024-01-08 12:50:49

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艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
17页	365K
描述
TQFP-32, Reel

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8402AYLFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	TQFP
包装说明：	7 X 7 MM, 1.40 MM HEIGHT, ROHS COMPLIANT, MS-026BBA, LQFP-32	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.68
JESD-30 代码：	S-PQFP-G32	JESD-609代码：	e3
长度：	7 mm	湿度敏感等级：	3
端子数量：	32	最高工作温度：	70 °C
最低工作温度：		最大输出时钟频率：	350 MHz
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装等效代码：	QFP32,.35SQ,32	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE	峰值回流温度（摄氏度）：	260
电源：	2.5/3.3,3.3 V	主时钟/晶体标称频率：	40 MHz
认证状态：	Not Qualified	座面最大高度：	1.6 mm
子类别：	Clock Generators	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	7 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

8402AYLFT 数据手册

ICS8402

Integrated

Circuit

ICS8402

_{350MHZ, CRYSTAL-TO-LVCMOS/ LVTTL FREQUENCY SYNTHE}3_SI5_ZE0_RMHZ, CRYSTAL-TO-LVCMOS / LVTT_TL_SD

Systems, Inc.

FREQUENCY SYNTHESIZER

TABLE 2. PIN CHARACTERISTICS

Symbol Parameter

Test Conditions

Minimum Typical Maximum Units

C_IN

Input Capacitance

kΩ

V_DD, V_DDA, V_DDO= 3.465V

Power Dissipation Capacitance

(per output)

C_PD

V_DD, V_DDA= 3.465V, V_DDO= 2.625V

R_PULLUP

Input Pullup Resistor

R_PULLDOWNInput Pulldown Resistor

R_OUTOutput Impedance

TABLE 3A. PARALLEL AND SERIAL MODE FUNCTION TABLE

Inputs

Conditions

MR nP_LOAD

S_LOAD S_CLOCK S_DATA

Reset. Forces outputs LOW.

Data on M and N inputs passed directly to the M

Data Data

divider and N output divider. TEST output forced LOW.

Data is latched into input registers and remains loaded

until next LOW transition or until a serial event occurs.

Serial input mode. Shift register is loaded with data on

S_DATA on each rising edge of S_CLOCK.

Contents of the shift register are passed to the

M divider and N output divider.

↑

Data

↓

↑

Data

M divider and N output divider values are latched.

Parallel or serial input do not affect shift registers.

S_DATA passed directly to M divider as it is clocked.

Data

NOTE: L = LOW

H = HIGH

X = Don't care

↑ = Rising edge transition

↓= Falling edge transition

8402AY

www.icst.com/products/hiperclocks.html

REV.C SEPTEMBER 1, 2005

IDT™ / ICS™ 350MHZ, CRYSTAL-TO-LVCMOS/ LVTTL FREQUENCY SYNTHESIZER

ICS8402

1 2 345 6 7...17

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