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813253AG

更新时间： 2024-02-12 07:19:46

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艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
22页	710K
描述
Clock Generator, 340MHz, PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, TSSOP-24

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813253AG 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	24
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.92
JESD-30 代码：	R-PDSO-G24	JESD-609代码：	e3
长度：	7.8 mm	端子数量：	24
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	340 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	240
主时钟/晶体标称频率：	125 MHz	认证状态：	Not Qualified
座面最大高度：	1.2 mm	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	20
宽度：	4.4 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

813253AG 数据手册

ICS813253

FEMTOCLOCK™ JITTER ATTENUATOR & FREQUENCY TRANSLATOR W/LVPECL OUTPUTS

PRELIMINARY

TABLE 4D. DIFFERENTIAL DC CHARACTERISTICS, V_CC= V_CCA= 3.3V 5ꢀ, TA=0°C TO 70°C

Symbol Parameter

Test Conditions

V_IN= V_CC= 3.465V

V_IN= 0V, V_CC= 3.465V

Minimum Typical Maximum Units

I_IH

Input High Current nCLK, CLK

150

µA

nCLK

CLK

-150

-5

I_IL

Input Low Current

_IN= 0V, V_CC= 3.465V

V_PP

Peak-to-Peak Input Voltage

0.15

1.3

V_CMR

Common Mode Input Voltage; NOTE 1, 2

V_EE+ 0.5

V_CC- 0.85

NOTE 1: Common mode voltage is defined as V_IH.

NOTE 2: For single ended applications, the maximum input voltage for CLK, nCLK is V_CC+ 0.3V.

TABLE 4E. LVPECL DC CHARACTERISTICS, V_CC= V_CCA= 3.3V 5ꢀ, V_CCO= 3.3V 5ꢀ OR 2.5V 5ꢀ, TA=0°C TO 70°C

Symbol

V_OH

Parameter

Test Conditions

Minimum

V_CCO- 1.4

V_CCO- 2.0

0.6

Typical

Maximum Units

Output High Voltage; NOTE 1

Output Low Voltage; NOTE 1

Peak-to-Peak Output Voltage Swing

V_CCO- 0.9

V_CCO- 1.7

1.0

V_OL

V_SWING

NOTE 1: Outputs terminated with 50Ω to V_CCO- 2V.

TABLE 5A. AC CHARACTERISTICS, V_CC= V_CCA= V_CCO= 3.3V 5ꢀ, TA=0°C TO 70°C

Symbol Parameter

Test Conditions

PSEL = ÷1

PSEL = ÷2.5

PSEL = ÷4

PSEL = ÷5

FSEL = ÷2

FSEL = ÷4

FSEL = ÷5

FSEL = ÷25

Minimum Typical Maximum Units

19.6

27.2

MHz

f_IN

Input Frequency

78.4

108.8

136

340

170

136

27.2

245

122.5

f_OUT

Output Frequency

19.6

156.25MHz, 25MHz crystal

Integration Range:

RMS Phase Jitter (Random);

NOTE 1

tjit(Ø)

0.37

1.875MHz - 20MHz

t_R/ t_F

tjit(cc)

tjit(per)

tsk(o)

odc

Output Rise/Fall Time

Cycle-to-Cycle Jitter; NOTE 2, 3

Period Jitter; NOTE 4

Output Skew; NOTE 3, 5

Output Duty Cycle

20ꢀ to 80ꢀ

400

800

ꢀ

t_LOCK

PLL Lock Time

NOTE 1: Please refer to the Phase Noise Plot.

NOTE 2: Outputs terminated with 50Ω to V_CCO- 2V.

NOTE 3: This parameter is defined in accordance with JEDEC Standard 65.

NOTE 4: Jitter performance using crystal inputs.

NOTE 5: Defined as skew between outputs at the same supply voltage and with equal load condtions.

Measured at the output differential cross points.

IDT^™/ ICS^™JITTER ATTENUATOR/FREQUENCY TRANSLATOR

ICS813253AG REV. A JANUARY 5, 2007

1 2 3 456 7 8...22

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型号	品牌	描述	获取价格	数据表
813253AGLF	IDT	Clock Generator, 340MHz, PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, TSSOP-24	获取价格
813253AGT	IDT	Clock Generator, 340MHz, PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, TSSOP-24	获取价格
813253BGLF	IDT	TSSOP-24, Tube	获取价格
8132-AB3-D-B	UTC	POWER RESET IC	获取价格
8132-AB3-D-K	UTC	POWER RESET IC	获取价格
8132-AB3-D-R	UTC	POWER RESET IC	获取价格

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