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74LVCH2T45GS

更新时间： 2023-09-03 20:28:01

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安世 - NEXPERIA		光电二极管逻辑集成电路
页数	文件大小	规格书
33页	413K
描述
Dual supply translating transceiver; 3-stateProduction

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74LVCH2T45GS 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	VSON,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.59
Is Samacsys：	N	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-N8	JESD-609代码：	e3
长度：	1.35 mm	逻辑集成电路类型：	BUS TRANSCEIVER
湿度敏感等级：	1	位数：	2
功能数量：	1	端口数量：	2
端子数量：	8	最高工作温度：	125 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	VSON	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, VERY THIN PROFILE	峰值回流温度（摄氏度）：	NOT SPECIFIED
传播延迟（tpd）：	23.5 ns	座面最大高度：	0.35 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	1.2 V
标称供电电压 (Vsup)：	1.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	Tin (Sn)	端子形式：	NO LEAD
端子节距：	0.35 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	1 mm
Base Number Matches：	1

74LVCH2T45GS 数据手册

74LVC2T45; 74LVCH2T45

Dual supply translating transceiver; 3-state

Rev. 12 — 1 March 2023

Product data sheet

1. General description

The 74LVC2T45; 74LVCH2T45 are dual bit, dual supply translating transceivers with 3-state

outputs that enable bidirectional level translation. They feature two 2-bits input-output ports

(nA and nB), a direction control input (DIR) and dual supply pins (V_CC(A)and V_CC(B)). Both V_CC(A)

and V_CC(B)can be supplied at any voltage between 1.2 V and 5.5 V making the device suitable

for translating between any of the low voltage nodes (1.2 V, 1.5 V, 1.8 V, 2.5 V, 3.3 V and 5.0 V).

Pins nA and DIR are referenced to V_CC(A)and pins nB are referenced to V_CC(B). A HIGH on DIR

allows transmission from nA to nB and a LOW on DIR allows transmission from nB to nA.

The devices are fully specified for partial power-down applications using I_OFF. The I_OFFcircuitry

disables the output, preventing any damaging backflow current through the device when it is

powered down. In suspend mode when either V_CC(A)or V_CC(B)are at GND level, both A port and

B port are in the high-impedance OFF-state.

Active bus hold circuitry in the 74LVCH2T45 holds unused or floating data inputs at a valid logic

level.

2. Features and benefits

•

Wide supply voltage range:

•

V_CC(A): 1.2 V to 5.5 V

V_CC(B): 1.2 V to 5.5 V

•

High noise immunity

Complies with JEDEC standards:

•

JESD8-7 (1.2 V to 1.95 V)

JESD8-5 (1.8 V to 2.7 V)

JESD8C (2.7 V to 3.6 V)

JESD36 (4.5 V to 5.5 V)

•

ESD protection:

•

HBM JESD22-A114F Class 3A exceeds 4000 V

MM JESD22-A115-A exceeds 200 V

CDM JESD22-C101E exceeds 1000 V

Maximum data rates:

•

420 Mbps (3.3 V to 5.0 V translation)

210 Mbps (translate to 3.3 V))

140 Mbps (translate to 2.5 V)

75 Mbps (translate to 1.8 V)

60 Mbps (translate to 1.5 V)

•

Suspend mode

Latch-up performance exceeds 100 mA per JESD 78 Class II

±24 mA output drive (V_CC= 3.0 V)

Inputs accept voltages up to 5.5 V

Low power consumption: 16 μA maximum I_CC

I_OFFcircuitry provides partial Power-down mode operation

Multiple package options

Specified from -40 °C to +85 °C and -40 °C to +125 °C

12 3 4 5 6 7...33

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与74LVCH2T45GS相关器件

型号	品牌	获取价格	描述	数据表
74LVCH2T45GT	NXP	获取价格	Dual supply translating transceiver; 3-state
74LVCH2T45GT	NEXPERIA	获取价格	Dual supply translating transceiver; 3-stateProduction
74LVCH2T45GT,115	NXP	获取价格	74LVC2T45; 74LVCH2T45 - Dual supply translating transceiver; 3-state SON 8-Pin
74LVCH2T45-Q100	NEXPERIA	获取价格	Dual supply translating transceiver; 3-state
74LVCH322244A	NXP	获取价格	32-bit buffer/line driver; with 30 ohm series termination resistors; 5 V input/output tole
74LVCH322244AEC	NXP	获取价格	32-bit buffer/line driver; with 30 ohm series termination resistors; 5 V input/output tole
74LVCH322244AEC/G	NXP	获取价格	IC LVC/LCX/Z SERIES, OCTAL 4-BIT DRIVER, TRUE OUTPUT, PBGA96, 13.50 X 5.50 MM, 1.05 MM HEI
74LVCH322244AEC;55	NXP	获取价格	74LVCH322244A - 32-bit buffer/line driver; wi
74LVCH322244AEC-S	NXP	获取价格	IC LVC/LCX/Z SERIES, OCTAL 4-BIT DRIVER, TRUE OUTPUT, PBGA96, 13.50 X 5.50 X 1.05 MM, PLAS
74LVCH322244AZKER	TI	获取价格	32-BIT BUFFER/DRIVER WITH 3-STATE OUTPUTS

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