74AC16373DL

更新时间： 2024-02-20 05:12:29

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德州仪器 - TI		总线驱动器总线收发器锁存器输出元件
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描述
16-BIT TRANSPARENT D-TYPE LATCHES WITH 3-STATE OUTPUTS

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技术参数
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74AC16373DL 技术参数

生命周期：	Obsolete	包装说明：	SSOP,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.71	系列：	AC
JESD-30 代码：	R-PDSO-G48	长度：	15.875 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	BUS DRIVER
位数：	8	功能数量：	2
端口数量：	2	端子数量：	48
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
传播延迟（tpd）：	8 ns	认证状态：	Not Qualified
座面最大高度：	2.8 mm	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	DUAL
宽度：	7.5 mm	Base Number Matches：	1

74AC16373DL 数据手册

54AC16373, 74AC16373

16-BIT TRANSPARENT D-TYPE LATCHES

WITH 3-STATE OUTPUTS

SCAS121B – MARCH 1990 – REVISED APRIL 1996

PARAMETER MEASUREMENT INFORMATION

2 × V

Open

GND

TEST

Open

PLH PHL

500 Ω

From Output

Under Test

2 × V

GND

PLZ PZL

PHZ PZH

= 50 pF

500 Ω

(see Note A)

LOAD CIRCUIT

Timing Input

(see Note B)

50%

0 V

Input

50%

Data Input

0 V

VOLTAGE WAVEFORMS

Output

Control

(low-level

enabling)

Input

50%

0 V

PZL

PHL

PLH

PLZ

Output

Waveform 1

In-Phase

Output

50% V

20% V

S1 at 2 × V

(see Note B)

PHZ

PLH

PHL

PZH

Output

Waveform 2

S1 at GND

0 V

Out-of-Phase

Output

80% V

50% V

(see Note B)

VOLTAGE WAVEFORMS

includes probe and jig capacitance.

VOLTAGE WAVEFORMS

NOTES: A.

B. Waveform 1 is for an output with internal conditions such that the output is low except when disabled by the output control.

Waveform 2 is for an output with internal conditions such that the output is high except when disabled by the output control.

C. All input pulses are supplied by generators having the following characteristics: PRR ≤ 1 MHz, Z = 50 Ω, t = 3 ns, t = 3 ns.

D. The outputs are measured one at a time with one input transition per measurement.

Figure 1. Load Circuit and Voltage Waveforms

POST OFFICE BOX 655303 • DALLAS, TEXAS 75265

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