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7018L15PF9

更新时间： 2024-09-29 07:58:31
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艾迪悌 - IDT 静态存储器内存集成电路
页数 文件大小 规格书
17页 154K
描述
TQFP-100, Tray

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7018L15PF9 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TQFP
包装说明：QFF,针数：100
Reach Compliance Code：not_compliant风险等级：5.84
最长访问时间：15 nsJESD-30 代码：S-PQFP-F100
JESD-609代码：e0内存密度：589824 bit
内存集成电路类型：DUAL-PORT SRAM内存宽度：9
湿度敏感等级：3功能数量：1
端子数量：100字数：65536 words
字数代码：64000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：64KX9封装主体材料：PLASTIC/EPOXY
封装代码：QFF封装形状：SQUARE
封装形式：FLATPACK并行/串行：PARALLEL
峰值回流温度（摄氏度）：240最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：FLAT端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIEDBase Number Matches：1

7018L15PF9 数据手册

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HIGH-SPEED  
64K x 9 DUAL-PORT  
STATIC RAM  
IDT7018L  
Features  
◆
than one device  
True Dual-Ported memory cells which allow simultaneous  
reads of the same memory location  
High-speed access  
◆
M/S = VIH for BUSY output flag on Master,  
M/S = VIL for BUSY input on Slave  
Interrupt Flag  
On-chip port arbitration logic  
Full on-chip hardware support of semaphore signaling  
between ports  
Fully asynchronous operation from either port  
TTL-compatible, single 5V (±10%) power supply  
Available in a 100-pin TQFP  
Industrial temperature range (–40°C to +85°C) is available  
for selected speeds  
◆
◆
◆
◆
– Commercial:15/20ns (max.)  
– Industrial:20ns (max.)  
Low-power operation  
◆
– IDT7018L  
◆
◆
◆
◆
Active:1W(typ.)  
Standby: 1mW (typ.)  
Dual chip enables allow for depth expansion without  
external logic  
IDT7018 easily expands data bus width to 18 bits or  
more using the Master/Slave select when cascading more  
◆
◆
FunctionalBlockDiagram  
L
R/W  
R
R/W  
CE0L  
CE1L  
CE0R  
CE1R  
OEL  
OE  
R
I/O  
Control  
I/O  
Control  
I/O0-8L  
I/O0-8R  
(1,2)  
BUSYL  
(1,2)  
BUSYR  
64Kx9  
MEMORY  
ARRAY  
7018  
A
15L  
A
A
15R  
0R  
Address  
Decoder  
Address  
Decoder  
A
0L  
16  
16  
ARBITRATION  
INTERRUPT  
SEMAPHORE  
LOGIC  
CE0L  
CE0R  
1L  
CE  
1R  
CE  
L
L
OE  
R/W  
OE  
R
R
R/W  
SEM  
INTL  
L
R
SEM  
(2)  
(2)  
R
INT  
M/S(1)  
4841 drw 01  
NOTES:  
1. BUSY is an input as a Slave (M/S = VIL) and an output when it is a Master (M/S = VIH).  
2. BUSY and INT are non-tri-state totem-pole outputs (push-pull).  
NOVEMBER 2001  
1
DSC-4841/3  
©2001IntegratedDeviceTechnology,Inc.  
1234567...17

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型号 品牌 获取价格 描述 数据表
7018L15PFI8 IDT

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